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包郵 FPGA應(yīng)用開(kāi)發(fā)技術(shù)
作者：田孝華編著
開(kāi)本：
26cm
頁(yè)數(shù)：
166頁(yè)
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FPGA應(yīng)用開(kāi)發(fā)技術(shù) 版權(quán)信息
- ISBN：9787560672878
- 條形碼：9787560672878 ; 978-7-5606-7287-8
- 裝幀：平裝-膠訂
- 冊(cè)數(shù)：暫無(wú)
- 重量：暫無(wú)
- 所屬分類(lèi)：>
FPGA應(yīng)用開(kāi)發(fā)技術(shù) 本書(shū)特色
本書(shū)詳細(xì)討論了FPGA在數(shù)字邏輯電路、信號(hào)源、濾波器、調(diào)制解調(diào)器等典型應(yīng)用領(lǐng)域的設(shè)計(jì)與實(shí)現(xiàn)。本書(shū)具有如下特點(diǎn)： **，實(shí)用性強(qiáng)。書(shū)中內(nèi)容結(jié)合項(xiàng)目展開(kāi)，包括實(shí)現(xiàn)方案、實(shí)現(xiàn)技術(shù)、仿真驗(yàn)證以及實(shí)驗(yàn)結(jié)果測(cè)試等，編寫(xiě)的程序經(jīng)過(guò)實(shí)驗(yàn)測(cè)試，可直接運(yùn)用于工程項(xiàng)目的開(kāi)發(fā)。 第二，應(yīng)用全面。本書(shū)不僅討論了數(shù)字邏輯電路與數(shù)字信號(hào)處理的FPGA實(shí)現(xiàn)，而且還詳細(xì)研究了數(shù)字基帶信號(hào)和模擬基帶信號(hào)的FPGA產(chǎn)生、中頻調(diào)制信號(hào)的FPGA實(shí)現(xiàn)，內(nèi)容全面，覆蓋面廣。 第三，詳細(xì)討論了IP資源的工程應(yīng)用。為提高FPGA應(yīng)用的開(kāi)發(fā)效率，F(xiàn)PGA生產(chǎn)廠家以及第三方公司開(kāi)發(fā)了大量的IP資源供用戶使用。通常IP核的參數(shù)需要工程技術(shù)人員結(jié)合具體的應(yīng)用場(chǎng)景以及專業(yè)知識(shí)進(jìn)行正確設(shè)置，本書(shū)詳細(xì)討論了IP核在工程中的具體應(yīng)用。
FPGA應(yīng)用開(kāi)發(fā)技術(shù) 內(nèi)容簡(jiǎn)介
本書(shū)討論了FPGA在數(shù)字邏輯電路、信號(hào)源、濾波器、中頻調(diào)制等典型應(yīng)用領(lǐng)域的設(shè)計(jì)與實(shí)現(xiàn)。全書(shū)共8章，分別為FPGA應(yīng)用概述、FPGA應(yīng)用硬件平臺(tái)、數(shù)字邏輯電路設(shè)計(jì)與FPGA實(shí)現(xiàn)、信號(hào)源設(shè)計(jì)與FPGA實(shí)現(xiàn)、FIR濾波器設(shè)計(jì)與FPGA實(shí)現(xiàn)、IIR濾波器設(shè)計(jì)與FPGA實(shí)現(xiàn)、DPSK調(diào)制器設(shè)計(jì)與FPGA實(shí)現(xiàn)、數(shù)控振蕩器及其應(yīng)用。通過(guò)學(xué)習(xí)本書(shū)可以掌握FPGA典型工程應(yīng)用的開(kāi)發(fā)技術(shù)。
FPGA應(yīng)用開(kāi)發(fā)技術(shù) 目錄
第1章 FPGA應(yīng)用概述 1
1.1 FPGA器件結(jié)構(gòu)與編程配置 1
1.1.1 FPGA器件及其結(jié)構(gòu) 1
1.1.2 FPGA編程與配置 5
1.2 FPGA設(shè)計(jì)語(yǔ)言 8
1.2.1 HDL語(yǔ)言的優(yōu)點(diǎn) 8
1.2.2 Verilog HDL功能 9
1.2.3 Verilog HDL程序結(jié)構(gòu) 9
1.3 FPGA開(kāi)發(fā)工具與設(shè)計(jì)流程 11
1.3.1 Quartus Ⅱ開(kāi)發(fā)軟件與下載器驅(qū)動(dòng)程序的安裝 11
1.3.2 ModelSim仿真軟件 12
1.3.3 FPGA設(shè)計(jì)流程 14
1.4 MATLAB及其在FPGA設(shè)計(jì)中的應(yīng)用 16
1.4.1 MATLAB簡(jiǎn)介 16
1.4.2 MATLAB在FPGA設(shè)計(jì)中的應(yīng)用 17
第2章 FPGA應(yīng)用硬件平臺(tái) 19
2.1 CRD500開(kāi)發(fā)板的結(jié)構(gòu)與組成 19
2.2 FPGA與板上資源的連接 21
2.2.1 EP4CE15F17C8引腳分布與定義 21
2.2.2 FPGA與板上資源的連接 29
第3章 數(shù)字邏輯電路設(shè)計(jì)與FPGA實(shí)現(xiàn) 32
3.1 項(xiàng)目要求 32
3.2 3-8譯碼器工作原理 32
3.3 3-8譯碼器設(shè)計(jì)與FPGA實(shí)現(xiàn) 33
3.4 FLASH程序生成與下載 68
第4章 信號(hào)源設(shè)計(jì)與FPGA實(shí)現(xiàn) 73
4.1 數(shù)字基帶信號(hào)設(shè)計(jì)與FPGA實(shí)現(xiàn) 73
4.1.1 項(xiàng)目要求 73
4.1.2 m序列及其產(chǎn)生原理 73
4.1.3 m序列的FPGA實(shí)現(xiàn) 76
4.2 模擬基帶信號(hào)設(shè)計(jì)與FPGA實(shí)現(xiàn) 78
4.2.1 項(xiàng)目要求 78
4.2.2 MATLAB輔助FPGA設(shè)計(jì)與實(shí)現(xiàn)步驟 79
4.2.3 MLS測(cè)角原理 79
4.2.4 MLS測(cè)角信號(hào)的FPGA實(shí)現(xiàn) 80
第5章 FIR濾波器設(shè)計(jì)與FPGA實(shí)現(xiàn) 91
5.1 項(xiàng)目要求 91
5.2 FIR濾波器工作原理 91
5.3 MATLAB輔助數(shù)字濾波器設(shè)計(jì)與實(shí)現(xiàn)步驟 93
5.4 通信干擾濾波器設(shè)計(jì)與FPGA實(shí)現(xiàn) 93
第6章 IIR濾波器設(shè)計(jì)與FPGA實(shí)現(xiàn) 108
6.1 項(xiàng)目要求 108
6.2 IIR濾波器工作原理 108
6.3 MLS測(cè)角濾波器實(shí)現(xiàn)方案 110
6.4 MLS測(cè)角濾波器設(shè)計(jì)與FPGA實(shí)現(xiàn) 111
第7章 DPSK調(diào)制器設(shè)計(jì)與FPGA實(shí)現(xiàn) 120
7.1 項(xiàng)目要求 120
7.2 DPSK調(diào)制原理 120
7.3 DPSK調(diào)制器實(shí)現(xiàn)方案 121
7.3.1 DPSK調(diào)制器組成 121
7.3.2 MATLAB輔助DPSK調(diào)制器設(shè)計(jì)與實(shí)現(xiàn)步驟 122
7.4 DPSK調(diào)制器設(shè)計(jì)與FPGA實(shí)現(xiàn) 122
7.4.1 MATLAB下濾波器設(shè)計(jì)與DPSK調(diào)制仿真 122
7.4.2 DPSK調(diào)制的FPGA實(shí)現(xiàn) 127
第8章 數(shù)控振蕩器及其應(yīng)用 136
8.1 數(shù)字鎖相環(huán)及其應(yīng)用 136
8.1.1 基于數(shù)字鎖相環(huán)的相干解調(diào) 137
8.1.2 基于數(shù)字鎖相環(huán)的相干載波提取 139
8.2 NCO IP核 141
8.2.1 NCO IP核的組成與輸入/輸出關(guān)系 141
8.2.2 NCO IP核的實(shí)現(xiàn)架構(gòu) 143
8.2.3 CORDIC算法原理 144
8.3 基于IP核的NCO開(kāi)發(fā)流程 146
8.4 基于NCO IP核的調(diào)制器設(shè)計(jì)與實(shí)現(xiàn) 151
8.4.1 基于NCO IP核的PSK調(diào)制器設(shè)計(jì)與實(shí)現(xiàn) 151
8.4.2 基于NCO IP核的FSK調(diào)制器設(shè)計(jì)與實(shí)現(xiàn) 154
附錄 159
附錄1 信號(hào)源數(shù)據(jù)文件(.mif) 159
附錄2 濾波器量化前后的系數(shù) 160
附錄3 信號(hào)源數(shù)據(jù)文件(.mif) 161
參考文獻(xiàn) 166
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