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雷達信號處理芯片技術 版權信息
- ISBN:9787118115284
- 條形碼:9787118115284 ; 978-7-118-11528-4
- 裝幀:一般膠版紙
- 冊數:暫無
- 重量:暫無
- 所屬分類:>
雷達信號處理芯片技術 內容簡介
高效軟件實現信號處理算法是現代數字陣列雷達發展的基本趨勢,實現這個目標的技術基礎是擁有一個高效能、高性能的高速數字信號處理器(DSP)。洪一、陳伯孝等著的《雷達信號處理芯片技術/雷達與探測前沿技術叢書》系統介紹“魂芯一號”高性能通用浮點數字信號處理器(BWDSP100)芯片結構及其特點、存儲器與寄存器、I/O資源及外設、指令系統、軟件編程、集成開發環境、硬件設計等內容,給出一些常用數字信號處理和雷達信號處理函數庫,并通過實際系統設計案例,介紹“魂芯一號”數字信號處理器的設計過程和解決方法。內容新穎,系統性強,理論聯系實際,突出工程實現和應用。 本書的讀者對象是各領域從事信號處理的科研和工程技術人員;本書也可以作為高等學校電子工程相關專業研究生和高年級本科生的參考用書。
雷達信號處理芯片技術 目錄
1.1 雷達信號處理概述
1.1.1 雷達信號處理的發展
1.1.2 雷達信號處理的特點
1.2 數字信號處理器
1.2.1 數字信號處理器概述
1.2.2 數字信號處理器的發展
1.2.3 “魂芯一號”高速數字信號處理器概述
第2章 處理器體系架構
2.1 體系架構
2.2 eCl04內核結構
2.2.1 運算單元執行宏(Macro)
2.2.2 運算部件
2.2.3 程序控制器
2.3 總線
2.4 內部存儲器
2.5 外設
第3章 存儲器與寄存器
3.1 地址空間
3.2 存儲器
3.2.1 存儲器的組織結構
3.2.2 存儲器數據總線操作
3.2.3 存儲器與其他部件的數據交換
3.3 地址發生運算器部件
3.4 尋址方式
3.5 地址沖突與地址非法
3.5.1 地址沖突
3.5.2 地址非法
3.6 總線仲裁
3.7 寄存器
3.7.1 全局控制寄存器GCSR
3.7.2 內核執行單元控制與標志寄存器
3.7.3 DMA控制寄存器
3.7.4 中斷控制寄存器
3.7.5 定時器控制寄存器
3.7.6 通用I/O控制寄存器
3.7.7 并口配置寄存器
3.7.8 uART控制寄存器
3.7.9 DDR2控制器的配置寄存器
3.7.10 數據存儲器讀寫沖突標志寄存器
第4章 處理器指令體系
4.1 指令結構與特點
4.1.1 指令基本語法規制
4.1.2 指令語法約定
4.1.3 指令速查
4.2 ALU指令
4.3 MuL指令
4.4 SPU指令
4.5 SHF指令
4.6 數據傳輸指令
雷達信號處理芯片技術 作者簡介
洪一,安徽銅陵人。1984年獲安徽大學無線電系學士學位,1987年畢業于西南電子技術研究所信息處理專業,同年獲成都電訊工程學院碩士學位。1987年進入西南雷達技術研究所并隨之同步轉到華東電子工程研究所工作至今,從事雷達信號處理研究及工程實現20年,2007年轉為從事集成電路設計工作。為我國數字化氣象雷達裝備和脈沖多普勒氣象雷達裝備信號處理系統、數字波束形成用于實際雷達裝備的開拓者。主持了我國從指令集、體系結構、物理實現、軟/硬件開發環境等均自主的高端浮點數字信號處理器——“魂芯一號”的研制。現為中國電子科技集團公司第三十八研究所集團首席科學家。安徽大學、合肥工業大學和中國科技大學博士生導師。安徽省首屆青年科技獎、全國五一勞動獎章等獲得者。獲國家科技進步獎一等獎、三等獎各一項,省部級獎十多項。享受“國務院政府特殊津貼”,是安徽省“115”產業創新團隊帶頭人。
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