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數(shù)字電路與邏輯設(shè)計 新形態(tài) 微課視頻版 版權(quán)信息
- ISBN：9787302671619
- 條形碼：9787302671619 ; 978-7-302-67161-9
- 裝幀：平裝-膠訂
- 冊數(shù)：暫無
- 重量：暫無
- 所屬分類：>
數(shù)字電路與邏輯設(shè)計 新形態(tài) 微課視頻版 本書特色
書本著簡潔、通俗、先進(jìn)和實用的原則精心編寫，重點著眼于方法和能力的培養(yǎng)。本書主要內(nèi)容數(shù)字邏輯電路的基本概念，邏輯代數(shù)基礎(chǔ)，邏輯門，組合邏輯電路、時序邏輯電路、存儲邏輯電路的分析方法、設(shè)計方法、功能器件，數(shù)字邏輯電路的仿真工具Logisim。本書每章有小結(jié)、習(xí)題（或思考題）,后有自測試卷，并附有部分習(xí)題答案和自測試卷答案，便于教學(xué)和自學(xué)。 本書可作為高等學(xué)校和成人高等教育各專業(yè)數(shù)字電路課程的教材（40～60學(xué)時）。本書也可供工程技術(shù)人員自學(xué)和參考。
數(shù)字電路與邏輯設(shè)計 新形態(tài) 微課視頻版 內(nèi)容簡介
本書基于高校工程教育認(rèn)證面向成果導(dǎo)向理念，將數(shù)字電路與邏輯設(shè)計的有關(guān)知識融為一體，系統(tǒng)介紹數(shù)字邏輯電路分析與設(shè)計的基本知識、理論和方法。同時，加入對數(shù)字邏輯電路仿真工具Logisim的詳細(xì)介紹。全書內(nèi)容包括數(shù)字電路基礎(chǔ)、數(shù)制與碼制、布爾代數(shù)基礎(chǔ)、集成邏輯門電路、組合邏輯電路、常用的集成組合邏輯電路、觸發(fā)器、時序邏輯電路、存儲邏輯電路，以及數(shù)字邏輯電路的仿真工具Logisim等。
本書圖文并茂、通俗易懂，體系新穎、結(jié)構(gòu)合理，可作為高等學(xué)校計算機(jī)、電子工程、自動化、通信等專業(yè)“數(shù)字邏輯”課程的教材，也可作為相關(guān)工程技術(shù)人員的參考資料。
數(shù)字電路與邏輯設(shè)計 新形態(tài) 微課視頻版 目錄
第1章數(shù)字電路基礎(chǔ)
1.1模擬信號與數(shù)字信號
1.2數(shù)字邏輯和邏輯電平
1.3數(shù)字電路
1.3.1數(shù)字電路的特點
1.3.2數(shù)字電路的發(fā)展
1.3.3數(shù)字電路的學(xué)習(xí)方法
習(xí)題
第2章數(shù)制與碼制
2.1數(shù)制
2.1.1常用的數(shù)制
2.1.2常用數(shù)制間的轉(zhuǎn)換
2.2碼制
2.2.1二十進(jìn)制代碼
2.2.2格雷碼
2.2.3奇偶校驗碼
2.2.4ASCII碼
習(xí)題
第3章布爾代數(shù)基礎(chǔ)
3.1邏輯函數(shù)與邏輯運(yùn)算
3.1.1邏輯函數(shù)的基本概念
3.1.2基本邏輯運(yùn)算
3.1.3復(fù)合邏輯運(yùn)算
3.1.4邏輯函數(shù)的表示方法
3.2布爾代數(shù)的基本定律和基本規(guī)則
3.2.1基本定律
3.2.2基本規(guī)則
3.3邏輯函數(shù)的化簡
3.3.1公式化簡法
3.3.2卡諾圖化簡法
習(xí)題
第4章集成邏輯門電路
4.1集成電路
4.1.1集成電路的分類
4.1.2集成電路的型號組成
4.1.3集成電路的封裝形式
4.2集成邏輯門電路
4.2.1常用邏輯門電路圖形符號
4.2.2典型的集成門電路
4.2.3集成門電路的使用特性
4.3正邏輯和負(fù)邏輯
4.3.1正邏輯與負(fù)邏輯的概念
4.3.2正邏輯與負(fù)邏輯的關(guān)系
習(xí)題
第5章組合邏輯電路
5.1組合邏輯電路的特點
5.2組合邏輯電路的分析
5.2.1組合邏輯電路的分析方法
5.2.2組合邏輯電路的分析舉例
5.3組合邏輯電路的設(shè)計
5.3.1組合邏輯電路的設(shè)計方法
5.3.2組合邏輯電路的設(shè)計舉例
5.3.3設(shè)計中實際問題的處理
5.4組合邏輯電路中的競爭冒險
5.4.1競爭冒險的產(chǎn)生
5.4.2競爭冒險的消除
習(xí)題
第6章常用的集成組合邏輯電路
6.1加法器
6.1.1半加器
6.1.2全加器
6.1.3多位加法器
6.2數(shù)值比較器
6.2.11位數(shù)值比較器
6.2.2多位數(shù)值比較器
6.3編碼器
6.3.1二進(jìn)制優(yōu)先編碼器
6.3.2二十進(jìn)制優(yōu)先編碼器
6.4譯碼器
6.4.1二進(jìn)制譯碼器
6.4.2二十進(jìn)制譯碼器
6.4.3數(shù)字顯示譯碼器
6.5多路選擇器和多路分配器
6.5.1多路選擇器
6.5.2多路分配器
6.6奇偶校驗器
習(xí)題
第7章觸發(fā)器
7.1雙穩(wěn)態(tài)元件
7.2SR觸發(fā)器
7.2.1直接控制的SR觸發(fā)器
7.2.2電平控制的SR觸發(fā)器
7.2.3邊沿控制的SR觸發(fā)器
7.3D觸發(fā)器
7.3.1直接控制的D觸發(fā)器
7.3.2電平控制的D觸發(fā)器
7.3.3邊沿控制的D觸發(fā)器
7.4JK觸發(fā)器
7.4.1直接控制的JK觸發(fā)器
7.4.2電平控制的JK觸發(fā)器
7.4.3邊沿控制的JK觸發(fā)器
7.5觸發(fā)器狀態(tài)的初始化
7.6常用的集成觸發(fā)器
7.6.1集成D觸發(fā)器
7.6.2集成JK觸發(fā)器
習(xí)題
第8章時序邏輯電路
8.1時序邏輯電路的結(jié)構(gòu)和特點
8.2時序邏輯電路的分析
8.2.1時序邏輯電路的分析方法
8.2.2時序邏輯電路的分析舉例
8.3計數(shù)器
8.3.1同步計數(shù)器的分析
8.3.2異步計數(shù)器的分析
8.4寄存器
8.4.1數(shù)碼寄存器
8.4.2移位寄存器
8.5時序邏輯電路的設(shè)計
8.5.1時序邏輯電路的設(shè)計方法
8.5.2時序邏輯電路的設(shè)計舉例
8.6常用的集成時序邏輯電路
8.6.1集成計數(shù)器
8.6.2集成寄存器
習(xí)題
第9章存儲邏輯電路
9.1存儲器概述
9.1.1存儲器分類
9.1.2存儲器性能指標(biāo)
9.2半導(dǎo)體RAM
9.2.1SRAM
9.2.2DRAM
9.3半導(dǎo)體RAM的結(jié)構(gòu)
9.3.1邏輯結(jié)構(gòu)
9.3.2地址譯碼方法
9.3.3存儲芯片舉例
9.4存儲器容量的擴(kuò)展
9.4.1位擴(kuò)展
9.4.2字?jǐn)U展
9.4.3字位同時擴(kuò)展
9.5半導(dǎo)體ROM
9.5.1ROM的分類
9.5.2ROM的結(jié)構(gòu)及容量擴(kuò)展舉例
習(xí)題
附錄A數(shù)字邏輯電路的仿真工具Logisim
A.1入門指南
A.1.1步驟1: 啟動Logisim
A.1.2步驟2: 加入邏輯門
A.1.3步驟3: 添加線路
A.1.4步驟4: 添加注釋文字
A.1.5步驟5: 電路仿真測試
A.2Logisim主要功能和使用
A.2.1庫和屬性
A.2.2子電路
A.2.3線路
A.2.4組合邏輯分析
A.2.5菜單功能說明
A.2.6存儲組件
A.2.7日志
A.2.8命令行測試
A.2.9項目選項
A.2.10Logisim值傳遞算法
A.2.11Logisim的不足之處
A.2.12Logisim使用總結(jié)
A.3Logisim組件庫
A.3.1線路庫
A.3.2邏輯門庫
A.3.3復(fù)用器庫
A.3.4運(yùn)算器庫
A.3.5存儲庫
A.3.6輸入/輸出庫
A.3.7基本庫
參考文獻(xiàn)
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