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包郵 XILINX FPGA權(quán)威設(shè)計指南:基于VIVADO 2023設(shè)計套件
作者：何賓
開本：
其他
頁數(shù)：
632
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XILINX FPGA權(quán)威設(shè)計指南:基于VIVADO 2023設(shè)計套件 版權(quán)信息
- ISBN：9787121475160
- 條形碼：9787121475160 ; 978-7-121-47516-0
- 裝幀：一般膠版紙
- 冊數(shù)：暫無
- 重量：暫無
- 所屬分類：>
XILINX FPGA權(quán)威設(shè)計指南:基于VIVADO 2023設(shè)計套件 本書特色
本書以Xilinx的集成開發(fā)環(huán)境Vivado 2023為載體，詳細(xì)介紹了Xilinx新一代UltraScale+系列FPGA的內(nèi)部結(jié)構(gòu)、Vivado集成開發(fā)環(huán)境、Vivado工程模式和非工程模式設(shè)計流程、創(chuàng)建和封裝IP、高級約束原理和實現(xiàn)方法、調(diào)式工具原理、部分可重配置原理及實現(xiàn)、HLS原理和實現(xiàn)、HDMI驅(qū)動原理和實現(xiàn)。 內(nèi)容全面：本書內(nèi)容涵蓋了現(xiàn)場可編程門陣列器件的內(nèi)部結(jié)構(gòu)、Vivado集成開發(fā)環(huán)境下工程模式和非工程模式的設(shè)計流程、IP的封裝和調(diào)用、時序和物理約束、動態(tài)功能交換、高級綜合工具，以及SelectIO資源的高級應(yīng)用（HDMI驅(qū)動）。 解讀詳細(xì)：對Vivado 2023集成開發(fā)環(huán)境的一些具體細(xì)節(jié)問題進(jìn)行更深入的分析和 講解，如UltraScale+器件內(nèi)部結(jié)構(gòu)的原理和使用方法、創(chuàng)建不包含源文件的IP核方法、基于工程的動態(tài)功能交換、高級綜合工具詳解，以及SelectIO資源的高級應(yīng)用。 實例豐富：為了幫助讀者全面掌握Vivado 2023集成開發(fā)工具的使用方法，本書配 套提供近70個設(shè)計實例，這些設(shè)計實例基本覆蓋了Vivado 2023設(shè)計套件所提供的設(shè)計功能。
XILINX FPGA權(quán)威設(shè)計指南:基于VIVADO 2023設(shè)計套件 內(nèi)容簡介
本書全面系統(tǒng)介紹了Xilinx新一代集成開發(fā)環(huán)境Vivado 2023的設(shè)計方法、設(shè)計流程和具體實現(xiàn)。全書共11章，內(nèi)容包括：Xilinx新一代UltraScale+架構(gòu)FPGA、Vivado設(shè)計套件導(dǎo)論、Vivado工程模式基本設(shè)計實現(xiàn)、Vivado非工程模式基本設(shè)計實現(xiàn)、Vivado創(chuàng)建和封裝用戶IP核流程、Vivado時序和物理約束原理及實現(xiàn)、Vivado調(diào)試工具原理及實現(xiàn)、Vivado動態(tài)功能交換原理及實現(xiàn)、Vitis HLS原理詳解、Vitis HLS實現(xiàn)過程詳解，以及HDMI顯示屏驅(qū)動原理和實現(xiàn)。本書參考了Xilinx近期新的Vivado 2023設(shè)計套件設(shè)計資料，理論與應(yīng)用并重，將Xilinx近期新的設(shè)計理論貫穿在具體的設(shè)計實現(xiàn)中。
XILINX FPGA權(quán)威設(shè)計指南:基于VIVADO 2023設(shè)計套件 目錄
目 錄
第 1章 Xilinx新一代UltraScale+架構(gòu)FPGA 1
1.1 UltraScale+結(jié)構(gòu)特點 1
1.1.1 Artix UltraScale+ FPGA系列 1
1.1.2 Kintex UltraScale+ FPGA系列 2
1.1.3 Virtex UltraScale+ FPGA系列 3
1.2 可配置邏輯塊 4
1.2.1 查找表功能和配置 7
1.2.2 多路復(fù)用器 10
1.2.3 進(jìn)位邏輯 21
1.2.4 存儲元件 29
1.2.5 分布式RAM（只有SLICEM） 33
1.2.6 只讀存儲器（ROM） 37
1.2.7 移位寄存器（只有SLICEM） 42
1.3 時鐘資源和時鐘管理模塊 45
1.3.1 時鐘架構(gòu)概述 45
1.3.2 時鐘布線資源概述 46
1.3.3 CMT概述 46
1.3.4 時鐘資源 47
1.3.5 時鐘管理模塊 52
1.4 存儲器資源 56
1.4.1 BRAM資源 56
1.4.2 UltraRAM資源 66
1.5 專用的DSP模塊 72
1.6 SelectIO資源 83
1.6.1 SelectIO接口資源 83
1.6.2 SelectIO接口通用指南 87
1.6.3 SelectIO接口邏輯資源 90
1.6.4 高密度I/O組 99
1.7 高速串行收發(fā)器 100
1.7.1 GTH和GTY收發(fā)器 101
1.7.2 GTM收發(fā)器 103
1.8 系統(tǒng)監(jiān)控器模塊 104
1.9 互聯(lián)資源 107
1.10 配置模塊 107
1.10.1 配置模式概述 108
1.10.2 JTAG連接 110
1.10.3 保護(hù)比特流 111
1.11 參考資料 112
第 2章 Vivado設(shè)計套件導(dǎo)論 113
2.1 Vivado設(shè)計套件框架 113
2.1.1 Vivado設(shè)計套件功能 113
2.1.2 Vivado設(shè)計套件支持的工業(yè)標(biāo)準(zhǔn) 114
2.1.3 Vivado對第三方工具的支持 114
2.2 Vivado系統(tǒng)級設(shè)計流程 114
2.3 Vivado兩種設(shè)計流程模式 117
2.3.1 工程模式 117
2.3.2 非工程模式 117
2.3.3 兩種模式不同點比較 118
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XILINX FPGA權(quán)威設(shè)計指南:基于VIVADO 2023設(shè)計套件 作者簡介
何賓，知名的嵌入式和EDA技術(shù)專家，長期從事電子設(shè)計自動化方面的教學(xué)和科研工作，與全球多家知名的半導(dǎo)體廠商和EDA工具廠商密切合作。已經(jīng)出版電子信息方面的著作共40余部，內(nèi)容涵蓋電路仿真、電路設(shè)計、FPGA、數(shù)字信號處理、單片機(jī)、嵌入式系統(tǒng)等。典型的代表作有《模擬電子系統(tǒng)設(shè)計指南（基礎(chǔ)篇）：從半導(dǎo)體、分立元件到TI集成電路的分析與實現(xiàn)》、《模擬電子系統(tǒng)設(shè)計指南（實踐篇）：從半導(dǎo)體、分立元件到TI集成電路的分析與實現(xiàn)》、《Xilinx Zynq-7000嵌入式系統(tǒng)設(shè)計與實現(xiàn)-基于ARM Cortex-A9雙核處理器和Vivado的設(shè)計方法》、《Altium Designer17一體化設(shè)計標(biāo)準(zhǔn)教程-從仿真原理和PCB設(shè)計到單片機(jī)系統(tǒng)》、《STC8系列單片機(jī)開發(fā)指南：面向處理器、程序設(shè)計和操作系統(tǒng)的分析與應(yīng)用》等。
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