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SOPC技術(shù)基礎(chǔ)教程(第2版修訂版) 版權(quán)信息
- ISBN：9787512134461
- 條形碼：9787512134461 ; 978-7-5121-3446-1
- 裝幀：一般膠版紙
- 冊(cè)數(shù)：暫無
- 重量：暫無
- 所屬分類：>>
SOPC技術(shù)基礎(chǔ)教程(第2版修訂版) 內(nèi)容簡(jiǎn)介
《SOPC技術(shù)基礎(chǔ)教程（第2版修訂本）》系統(tǒng)地介紹了基于FPGA的SOPC的軟硬件開發(fā)技術(shù)，以一個(gè)簡(jiǎn)單的設(shè)計(jì)實(shí)例為主線介紹軟硬件的開發(fā)流程、開發(fā)工具的使用及開發(fā)的思想，使讀者對(duì)SOPC技術(shù)有一個(gè)基本的了解。將NiosⅡ體系結(jié)構(gòu)、Avalon總線規(guī)范、NiosⅡ處理器常用外部設(shè)備的更多底層細(xì)節(jié)提供給讀者，使讀者獲得進(jìn)行高級(jí)開發(fā)的能力，如第8章介紹的定制指令、定制外設(shè)開發(fā)和C2H編譯器的使用。另外還介紹了使用MATLAB和DSPBuilder進(jìn)行基于FPGA的DSP開發(fā)技術(shù)，并提供了一些典型的實(shí)驗(yàn)。 《SOPC技術(shù)基礎(chǔ)教程（第2版修訂本）》可作為高等院校電子信息類各專業(yè)本科生、研究生的教材，也可以作為相關(guān)工程技術(shù)人員的參考書。
SOPC技術(shù)基礎(chǔ)教程(第2版修訂版) 目錄
第1章 緒論
1．1 基本概念
1．1．1 SOC
1．1．2 SOPC
1．1．3 lP核
1．2 NiosⅡ軟核處理器簡(jiǎn)介
1．2．1 可定制特性
1．2．2 系統(tǒng)性能可配置性
1．2．3 延長(zhǎng)產(chǎn)品生存周期
1．3 SOPC設(shè)計(jì)流程
1．4 支持NiosⅡCPU的FPGA型號(hào)
1．4．1 Cyclone和CycloneⅡ系列
1．4．2 Stratix和StratixⅡ系列
1．5 *新的FPGA系列器件
第2章 SOPC的硬件開發(fā)環(huán)境及硬件開發(fā)流程
2．1 創(chuàng)建QuartusⅡ工程
2．2 創(chuàng)建NiosⅡ系統(tǒng)模塊
2．2．1 創(chuàng)建頂層實(shí)體
2．2．2 創(chuàng)建NiosⅡ系統(tǒng)模塊
2．2．3 分配IP模塊的地址和中斷號(hào)
2．2．4 配置NiosⅡ系統(tǒng)
2．2．5 生成NiosⅡ并加入到工程中
2．2．6 加入引腳和嵌入式鎖相環(huán)
2．3 設(shè)計(jì)優(yōu)化
2．3．1 面積與速度的優(yōu)化
2．3．2 時(shí)序約束與設(shè)置
2．3．3 Fitter設(shè)置
2．4 編譯
2．4．1 編譯設(shè)置
2．4．2 引腳分配
2．4．3 編譯用戶設(shè)計(jì)
2．5 編程下載
2．5．1 下載
2．5．2 驗(yàn)證
第3章 NiosⅡ體系結(jié)構(gòu)
3．1 NiosⅡ處理器結(jié)構(gòu)
3．2 NiosⅡ寄存器文件
3．2．1 通用寄存器
3．2．2 控制寄存器
3．3 存儲(chǔ)器和I/O組織
3．3．1 指令和數(shù)據(jù)總線
3．3．2 高速緩存
3．3．3 緊耦合存儲(chǔ)器
3．3．4 地址映射
3．4 尋址方式
第4章 Avalon總線規(guī)范
4．1 Avalon總線簡(jiǎn)介
4．2 Avalon總線基本概念
4．2．1 Avalon外設(shè)和交換架構(gòu)
4．2．2 Avalon信號(hào)
4．2．3 主端口和從端口
4．2．4 傳輸
4．2．5 主從端口對(duì)
4．2．6 周期
4．3 Avalon信號(hào)
4．3．1 信號(hào)類型的完整列表
4．3．2 信號(hào)極性
4．3．3 信號(hào)命名規(guī)則
4．3．4 Avalon信號(hào)時(shí)序說明
4．3．5 傳輸屬性
4．4 從端口傳輸
4．4．1 從端口信號(hào)詳述
4．4．2 從端口讀傳輸
4．4．3 從端口寫傳輸
4．5 主端口傳輸
……
第5章 基于FPGA的DSP開發(fā)技術(shù)
第6章 軟件設(shè)計(jì)流程和方法
第7章 NiosⅡ常用外設(shè)編程
第8章 NiosⅡ系統(tǒng)高級(jí)開發(fā)
附錄A 電子鐘C語(yǔ)言的源程序和頭文件
附錄B GX-SOC/SOPC專業(yè)級(jí)創(chuàng)新開發(fā)實(shí)驗(yàn)平臺(tái)硬件介紹
附錄C SOPC實(shí)驗(yàn)
參考文獻(xiàn)
1．1 基本概念
1．1．1 SOC
1．1．2 SOPC
1．1．3 lP核
1．2 NiosⅡ軟核處理器簡(jiǎn)介
1．2．1 可定制特性
1．2．2 系統(tǒng)性能可配置性
1．2．3 延長(zhǎng)產(chǎn)品生存周期
1．3 SOPC設(shè)計(jì)流程
1．4 支持NiosⅡCPU的FPGA型號(hào)
1．4．1 Cyclone和CycloneⅡ系列
1．4．2 Stratix和StratixⅡ系列
1．5 *新的FPGA系列器件
第2章 SOPC的硬件開發(fā)環(huán)境及硬件開發(fā)流程
2．1 創(chuàng)建QuartusⅡ工程
2．2 創(chuàng)建NiosⅡ系統(tǒng)模塊
2．2．1 創(chuàng)建頂層實(shí)體
2．2．2 創(chuàng)建NiosⅡ系統(tǒng)模塊
2．2．3 分配IP模塊的地址和中斷號(hào)
2．2．4 配置NiosⅡ系統(tǒng)
2．2．5 生成NiosⅡ并加入到工程中
2．2．6 加入引腳和嵌入式鎖相環(huán)
2．3 設(shè)計(jì)優(yōu)化
2．3．1 面積與速度的優(yōu)化
2．3．2 時(shí)序約束與設(shè)置
2．3．3 Fitter設(shè)置
2．4 編譯
2．4．1 編譯設(shè)置
2．4．2 引腳分配
2．4．3 編譯用戶設(shè)計(jì)
2．5 編程下載
2．5．1 下載
2．5．2 驗(yàn)證
第3章 NiosⅡ體系結(jié)構(gòu)
3．1 NiosⅡ處理器結(jié)構(gòu)
3．2 NiosⅡ寄存器文件
3．2．1 通用寄存器
3．2．2 控制寄存器
3．3 存儲(chǔ)器和I/O組織
3．3．1 指令和數(shù)據(jù)總線
3．3．2 高速緩存
3．3．3 緊耦合存儲(chǔ)器
3．3．4 地址映射
3．4 尋址方式
第4章 Avalon總線規(guī)范
4．1 Avalon總線簡(jiǎn)介
4．2 Avalon總線基本概念
4．2．1 Avalon外設(shè)和交換架構(gòu)
4．2．2 Avalon信號(hào)
4．2．3 主端口和從端口
4．2．4 傳輸
4．2．5 主從端口對(duì)
4．2．6 周期
4．3 Avalon信號(hào)
4．3．1 信號(hào)類型的完整列表
4．3．2 信號(hào)極性
4．3．3 信號(hào)命名規(guī)則
4．3．4 Avalon信號(hào)時(shí)序說明
4．3．5 傳輸屬性
4．4 從端口傳輸
4．4．1 從端口信號(hào)詳述
4．4．2 從端口讀傳輸
4．4．3 從端口寫傳輸
4．5 主端口傳輸
……
第5章 基于FPGA的DSP開發(fā)技術(shù)
第6章 軟件設(shè)計(jì)流程和方法
第7章 NiosⅡ常用外設(shè)編程
第8章 NiosⅡ系統(tǒng)高級(jí)開發(fā)
附錄A 電子鐘C語(yǔ)言的源程序和頭文件
附錄B GX-SOC/SOPC專業(yè)級(jí)創(chuàng)新開發(fā)實(shí)驗(yàn)平臺(tái)硬件介紹
附錄C SOPC實(shí)驗(yàn)
參考文獻(xiàn)
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