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數字設計基礎及應用/余建坤等/應用型高等院校改革創新示范教材 版權信息
- ISBN：9787517071419
- 條形碼：9787517071419 ; 978-7-5170-7141-9
- 裝幀：一般膠版紙
- 冊數：暫無
- 重量：暫無
- 所屬分類：>>
數字設計基礎及應用/余建坤等/應用型高等院校改革創新示范教材 內容簡介
本書與傳統數字技術方面的教材相比，除了介紹數字電路與邏輯設計的基本理論與知識外，更注重數字系統設計和現代很新技術與器件的應用。本書把基本數字電路內容、數字系統設計和基于EDA的復雜系統仿真與設計實現有機融合起來，也就是把數字電路與邏輯設計和EDA合并成了一門課。本書共有11章，分別是數字信號與數字系統、邏輯代數和邏輯門、組合邏輯電路、觸發器、時序邏輯電路、脈沖的產生和整形電路、存儲器電路、模/數和數/模轉換電路、大規模可編程邏輯器件及邊界掃描電路、VHDL編程、數字系統設計與應用。為了便于學生自學及雙語教學，本書在每章之前，給出了內容提要、教學建議、學習要求和中英文關鍵詞。各章配有一定量的習題。全書參考學時數為80學時，只學數字電路與邏輯設計部分或EDA部分的，建議學時為48學時。數字設計具有很強的實踐性，必須有一定量的實驗和實踐教學環節相配合，建議開設32課時的實驗，有條件的專業可另開設綜合實驗或課程設計。
數字設計基礎及應用/余建坤等/應用型高等院校改革創新示范教材 目錄
前言
第1章 數字信號與數字系統
1.1 數字信號與模擬信號
1.2 數字電路與數字系統
1.2.1 數字電路
1.2.2 數字系統及其結構
1.2.3 數字系統應用與分類
1.3 數字系統設計流程與方法
1.3.1 數字系統設計流程
1.3.2 數字系統設計方法
1.4 EDA技術概述
1.4.1 EDA技術及其發展
1.4.2 EDA技術的涵義
1.4.3 EDA技術的主要內容
1.4.4 EDA的工程設計流程及工具
1.4.5 EDA技術的應用形式
1.4.6 EDA技術的發展趨勢
1.5 數制與編碼
1.5.1 數制
1.5.2 帶符號數的表示法
1.5.3 二進制數的算術運算
1.5.4 信息的二進制編碼表示
習題1
第2章 邏輯代數和邏輯門
2.1 邏輯代數
2.1.1 邏輯代數的基本概念
2.1.2 邏輯代數的基本運算與邏輯門
2.1.3 復合邏輯運算常用邏輯門
2.1.4 邏輯代數的基本定律與運算規則
2.2 邏輯函數的描述方式
2.2.1 邏輯函數及其特點
2.2.2 邏輯函數相等
2.2.3 邏輯函數的表示方法
2.2.4 各種表現形式的相互轉換
2.2.5 邏輯函數的兩種標準形式
2.3 邏輯函數的化簡
2.3.1 邏輯函數化簡的基本思想
2.3.2 代數化簡法（公式化簡法）
2.3.3 卡諾圖化簡法
2.3.4 非完全描述邏輯函數及其化簡
2.4 集成邏輯門
2.4.1 概述
2.4.2 二極管（Diode）構成的邏輯門電路
2.4.3 TTL集成門電路
2.4.4 CMOS門電路
2.4.5 集成CMOS邏輯門系列和參數簡介
習題2
第3章 組合邏輯電路
3.1 組合邏輯電路的特點和定義
3.2 組合邏輯電路的分析
3.3 組合邏輯電路的設計
3.4 加法器
3.4.1 1位加法器
3.4.2 多位加法器
3.5 編碼器
3.5.1 普通編碼器
3.5.2 優先編碼器
3.6 譯碼器
3.6.1 二進制譯碼器
3.6.2 二一十進制譯碼器
3.6.3 顯示譯碼器
3.7 數據選擇器和數據分配器
3.7.1 4選1數據選擇器
3.7.2 8選1數據選擇器
3.7.3 數據選擇器的應用
3.8 組合邏輯電路中的競爭-冒險現象
3.8.1 競爭-冒險現象及成因
3.8.2 消除競爭-冒險現象的方法
習題3
第4章 觸發器
4.1 基本觸發器
基本RS觸發器
4.2 同步RS觸發器
4.3 主從觸發器
4.3.1 主從RS觸發器
4.3.2 主從JK觸發器
4.4 邊沿觸發器
4.4.1 維持-阻塞邊沿D觸發器
4.4.2 CMOS主從結構的邊沿觸發器
4.5 集成觸發器
4.5.1 常用集成觸發器
4.5.2 觸發器功能的轉換
4.5.3 集成觸發器的脈沖工作特性
4.5.4 集成觸發器的應用舉例
習題4
第5章 時序邏輯電路
5.1 時序邏輯電路的基本概念
5.1.1 時序邏輯電路的結構和特點
5.1.2 時序邏輯電路的描述方法
5.1.3 時序邏輯電路的分類
5.2 時序邏輯電路的分析方法
5.3 計數器
5.3.1 概述
5.3.2 二進制計數器
5.3.3 其他進制計數器
5.3.4 集成計數器的應用
5.4 數碼寄存器與移位寄存器
5.4.1 數碼寄存器
5.4.2 移位寄存器
5.4.3 集成移位寄存器74LS194
5.4.4 移位寄存器構成的移位型計數器
5.5 時序邏輯電路的設計方法
5.5.1 基于觸發器的同步時序邏輯電路的設計方法
5.5.2 異步時序邏輯電路的設計方法
5.5.3 基于MSI模塊的同步時序電路設計
習題5
第6章 脈沖的產生和整形電路
6.1 單穩態觸發器
6.1.1 微分型單穩態觸發器
6.1.2 集成單穩態觸發器——74LS121
6.2 施密特觸發器
6.3 多諧振蕩器
6.4 集成555定時器
習題6
第7章 存儲器電路
7.1 概述
7.1.1 一般結構
7.1.2 分類
7.1.3 半導體存儲器的主要性能指標
7.2 ROM
7.2.1 掩模ROM
7.2.2 PROM
7.2.3 可擦可編程ROM
7.2.4 快閃存儲器（Flash Memory）
7.3 RAM
7.3.1 SRAM
7.3.2 DRAM
7.4 存儲器容量的擴展
7.4.1 位擴展方式
7.4.2 字擴展方式
7.5 存儲器應用
7.5.1 ROM應用
7.5.2 RAM應用
習題7
第8章 模/數和數/模轉換電路
8.1 概述
8.2 模/數轉換電路
8.2.1 A/D轉換過程及基本概念
8.2.2 常用A/D轉換技術
8.2.3 集成ADC的主要性能指標
8.2.4 8位集成A/D轉換器ADC0809
8.3 數/模轉換電路
8.3.1 DAC的基本結構和工作原理
8.3.2 常用數/模轉換電路
8.3.3 集成DAC的主要性能指標
8.3.4 8位D/A轉換器DAC0832及應用
習題8
第9章 大規模可編程邏輯器件及邊界掃描電路
9.1 可編程邏輯器件概述
9.1.1 PLD的發展進程
9.1.2 PLD的種類及分類方法
9.1.3 常用CPLD/FPGA簡介
9.1.4 常用CPLD/FPGA標識的含義
9.2 CPID和FPGA的基本結構
9.2.1 CPLD的基本結構
9.2.2 FPGA的基本結構
9.3 FPGA/CPLD的測試技術
9.3.1 內部邏輯測試
9.3.2 JTAG邊界測試技術
9.4 CPLD和FPGA的編程與配置
9.4.1 CPLD和FPGA的下載接口
9.4.2 CPLD器件的下載接口及其連接
9.4.3 FPGA器件的配置模式
9.4.4 使用配置器件配置（重配置）FPGA器件
9.5 FPGA和CPLD的開發應用選擇
9.5.1 開發應用選擇方法
9.5.2 三大廠家的選擇
9.6 應用電路舉例
習題9
第10章 VHDL編程
10.1 VHDL語言的程序結構
10.1.1 庫與程序包
10.1.2 實體語句結構
10.1.3 結構體
10.2 VHDL語言要素
10.2.1 VHDL文字規則
10.2.2 數據類型
10.2.3 VHDL的數據對象
10.3 VHDL順序語句
10.3.1 賦值語句
10.3.2 流程控制語句
10.4 VHDL并行語句
10.4.1 概述
10.4.2 并行信號賦值語句
10.4.3 進程語句
10.4.4 塊語句
10.4.5 元件例化語句
10.4.6 生成語句
10.4.7 并行過程調用語句
10.5 Ouartus II時序仿真與硬件實現
10.5.1 VHDL程序輸入與仿真測試
10.5.2 引腳鎖定與鎖定與硬件測試
10.5.3 SignalTap II的使用方法
10.6 vHDL有限狀態機設計
10.6.1 VHDL有限狀態機設計具有的優勢
10.6.2 狀態機的一般結構
10.6.3 ADCC0809的采樣電路的VHDL描述
習題10
第11章 數字系統的設計及應用
11.1 移位相加8×8位硬件乘法器
11.2 電子琴電路設計
11.2.1 電子琴設計原理
11.2.2 硬件設計
11.3 直流電機綜合測控系統設計
11.3.1 直流電機PWM調速原理
11.3.2 基于FPGA的直流電機調速方案
11.3.3 直流電機PWM調速控制電路設計
11.3.4 FPGA內部邏輯電路組成及
各個模塊的詳解
11.4 交通燈控制系統設計
11.4.1 設計任務與要求
11.4.2 交通燈控制系統的基本組成模塊
11.4.3 交通燈控制系統的VHDL語言實現
習題11
參考文獻
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數字設計基礎及應用/余建坤等/應用型高等院校改革創新示范教材 作者簡介
余建坤，1970年5月生，河北邯鄲人，碩士研究生，邵陽學院計算機學院教師，主要從事電路理論、數字信息處理等課程的教學工作，編寫過多部教材，在國內核心期刊和省級期刊上發表過多篇文章，是我社長期合作作者。
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