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包郵 EDA技術與VHDL

出版社:北京大學出版社出版時間:2009-03-01
開本: 16開 頁數: 265
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EDA技術與VHDL 版權信息

EDA技術與VHDL 本書特色

本書是作者在多年開發和教授EDA技術經驗的基礎上編寫而成的。書中所有設計程序均在Quartus Ⅱ開發環境下通過了仿真,并在杭州康芯公司生產的Gw48一PK2/CK實驗與開發系統上通過了硬件測試,實例對大部分實驗現象和結果進行了詳細分析。 全書按照CPLD/FPGA器件介紹、VHDL介紹、Quartus Ⅱ開發工具介紹、基本電路和應用電路設計、實驗操作的順序編寫。 本書可作為高等職業技術院校電子類、電氣類、通信類、自動化類和計算機類專業的教材,電子產品制作、科技創新實踐、課程設計和畢業設計等實踐活動的指導書,也可作為職業技術培訓及從事電子產品設計與開發的工程技術人員的參考書。

EDA技術與VHDL 內容簡介

本書主要內容有Altera公司可編程器件及器件的選用、QuartusII開發工具的使用;VHDL硬件描述語言及豐富的數字電路及電子數字系統EDA設計實例。

EDA技術與VHDL 目錄

第1章 EDA技術概述1.1 EDA技術及其發展1.1.1 EDA技術的發展1.1.2 EDA技術的涵義1.1.3 EDA技術的基本特征1.2 EDA技術的主要內容及主要的EDA廠商1.2.1 EDA技術的主要內容1.2.2 主要EDA廠商概述1.3 EDA技術實現目標1.3.1 超大規模可編程邏輯器件1.3.2 半定制或全定制ASIC1.3.3 混合ASIC1.4 EDA技術應用1.4.1 EDA技術應用形式1.4.2 EDA技術應用場合1.5 EDA技術的發展趨勢1.5.1 可編程器件的發展趨勢1.5.2 軟件開發工具的發展趨勢1.5.3 輸入方式的發展趨勢本章小結思考題和習題第2章 大規模可編程邏輯器件2.1 可編程邏輯器件概述2.1.1 PLD的發展進程2.1.2 PLD的種類及分類方法2.2 簡單可編程邏輯器件2.2.1 PLD電路的表示方法及有關符號2.2.2 PROM基本結構2.2.3 PLA基本結構2.2.4 PAL基本結構2.2.5 GAL基本結構2.3 復雜可編程邏輯器件2.3.1 CPLD基本結構2.3.2 Altera公司器件2.4 現場可編程邏輯器件2.4.1 FPGA整體結構2.4.2 Xilinx公司FPGA器件2.5 在系統可編程邏輯器件2.5.1 ispLSl/pLSl的結構2.5.2 Lattice公司ispLSI系列器件2.6 FPGA和CPLD的開發應用2.6.1 CPLD和FPGA的編程與配置2.6.2 FPGA和CPLD的性能比較2.6.3 FPGA和CPLD的應用選擇本章小結思考題和習題第3章 EDA設計流程與開發3.1 EDA設計流程3.1.1 設計輸入3.1.2 綜合3.1.3 適配3.1.4 時序仿真與功能仿真3.1.5 編程下載3.1.6 硬件測試3.2 ASIC及其設計流程3.2.1 ASIC設計方法3.2.2 一般的ASIC設計流程3.3 可編程邏輯器件的開發環境 3.4 硬件描述語言3.5 IP核本章小結思考題和習題第4章 硬件描述語言VHDL4.1 VHDL概述4.1.1 VHDL的發展歷程4.1.2 VHDL的特點4.2 VHDL程序基本結構4.2.1 實體4.2.2 結構體4.2.3 庫4.2.4 程序包4.2.5 配置4.3 VHDL基本要素4.3.1 文字規則4.3.2 數據對象4.3.3 數據類型4.3.4 運算操作符4.3.5 VHDL結構體描述方式4.4 VHDL順序語句4.4.1 賦值語句4.4.2 IF語句4.4.3 等待和斷言語句4.4.4 cASE語句4.4.5 LOOP語句4.4.6 RETIARN語句4.4.7 過程調用語句4.4.8 REPORT語句4.5 VHDL并行語句4.5.1 進程語句4.5.2 塊語句4.5.3 并行信號代人語句4.5.4 并行過程調用語句4.5.5 并行斷言語句4.5.6 參數傳遞語句4.5.7 元件例化語句本章小結思考題和習題第5章 QuartusⅡ軟件及其應用5.1 基本設計流程5.1.1 建立工作庫文件夾和編輯設計文件5.1.2 創建工程5.1.3 編譯前設計5.1.4 全程編譯5.1.5 時序仿真5.1.6 應用RTL電路圖觀察器5.2 引腳設置和下載5.2.1 引腳鎖定5.2.2 配置文件下載5.2.3 AS模式編程配置器件5.2.4 JTAG間接模式編程配置器件5.2.5 USBBlaster編程配置器件使用方法本章小結思考題和習題第6章 VHDL應用實例6.1 組合邏輯電路設計6.1.1 基本門電路設計6.1.2 譯碼器設計6.1.3 數據選擇器設計6.1.4 三態門設計6.1.5 編碼器設計6.1.6 數值比較器設計6.2 時序邏輯電路設計6.2.1 時鐘信號和復位信號6.2.2 觸發器設計6.2.3 寄存器和移位寄存器設計6.2.4 計數器設計6.2.5 存儲器設計6.3 綜合實例——數字秒表的設計本章小結思考題和習題第7章 狀態機設計7.1 一般有限狀態機7.1.1 數據類型定義語句7.1.2 為什么要使用狀態機7.1.3 一般有限狀態機的設計7.2 Moore型有限狀態機設計7.2.1 多進程有限狀態機7.2.2 單進程有限狀態機7.3 Mealy型有限狀態機7.4 狀態編碼7.4.1 狀態位直接輸出型編碼7.4.2 順序編碼7.4.3 一位熱碼編碼7.5 狀態機處理本章小結思考題和習題第8章 EDlA實驗開發系統8.1 GW48型實驗開發系統原理與應用8.1.1 系統性能及使用注意事項8.1.2 GW48系統主板結構與使用方法8.2 實驗電路結構圖8.2.1 實驗電路信號資源符號圖說明8.2.2 各實驗電路結構圖特點與適用范圍簡述8.3 GW48CK/GK/EK/PK2系統信號名與芯片引腳對照表本章小結思考題和習題第9章 EnA技術實驗實驗一:全加器的設計實驗二:4位加減法器的設計實驗三:基本D觸發器的設計實驗四:同步清零計數器的設計實驗五:基本移位寄存器的設計串人/串出移位寄存器實驗六:同步預置數串行輸出移位寄存器的設計實驗七:半整數分頻器的設計實驗八:音樂發生器的設計實驗九:交通燈控制器的設計實驗十:數字時鐘的設計參考文獻
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