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數字系統設計與VHDL(第3版) 版權信息
- ISBN：9787121483950
- 條形碼：9787121483950 ; 978-7-121-48395-0
- 裝幀：一般膠版紙
- 冊數：暫無
- 重量：暫無
- 所屬分類：>
數字系統設計與VHDL(第3版) 內容簡介
根據電子信息類課程理論教學和實踐教學要求，以提高數字系統設計能力為目的，系統闡述EDA技術、FPGA/CPLD器件、VHDL語言和相關數字系統設計技術。以Quartus Prime、ModelSim軟件為工具，按"器件-軟件-語言-案例”為主線展開，內容緊貼教學實際，以可綜合的設計為重點，通過諸多精選設計案例，闡述數字系統設計的方法，由淺入深介紹VHDL工程開發的技能。案例豐富，富于啟發，并全部基于目標板做了驗證。VHDL語言規則以VHDL-1993、VHDL-2002和VHDL-2008語言標準為依據，涵蓋所有常用語法規則，對語言、語法規則用案例做闡釋，用綜合工具和仿真工具做驗證，語言講解全面深入，既適合作為**語法資料查詢，也適合設計人員閱讀參考。
數字系統設計與VHDL(第3版) 目錄
第1章 EDA技術概述 1
1.1 EDA技術及其發展歷程 1
1.2 Top-down設計思路 2
1.2.1 Top-down設計 3
1.2.2 Bottom-up設計 3
1.3 IP核復用 4
1.3.1 IP核復用技術 4
1.3.2 片上系統SoC 5
1.4 EDA設計的流程 6
1.4.1 設計輸入 6
1.4.2 綜合 6
1.4.3 布局布線 7
1.4.4 時序分析 7
1.4.5 功能仿真與時序仿真 7
1.4.6 編程與配置 8
1.5 常用的EDA工具軟件 8
習題1 11
第2章 FPGA/CPLD器件 12
2.1 PLD器件概述 12
2.1.1 PLD器件的發展歷程 12
2.1.2 PLD器件的分類 12
2.2 PLD的原理與結構 14
2.3 低密度PLD的原理與結構 15
2.4 CPLD的原理與結構 18
2.4.1 宏單元結構 18
2.4.2 典型CPLD的結構 19
2.5 FPGA的原理與結構 20
2.5.1 查找表結構 21
2.5.2 典型FPGA的結構 23
2.5.3 MAX 10器件結構 24
2.5.4 Cyclone IV器件結構 27
2.6 FPGA/CPLD的編程工藝 29
2.6.1 熔絲型開關 29
2.6.2 反熔絲型開關 29
2.6.3 浮柵編程工藝 30
2.6.4 SRAM編程工藝 31
2.7 邊界掃描測試技術 32
2.8 FPGA/CPLD的編程與配置 33
2.8.1 在系統可編程 33
2.8.2 Cyclone IV器件的配置 35
2.8.3 MAX 10器件的配置 37
2.9 FPGA/CPLD產品系列 38
習題2 40
第3章 原理圖與基于IP核的設計 42
3.1 Quartus Prime設計流程 42
3.2 原理圖設計方式 43
3.2.1 半加器設計 43
3.2.2 1位全加器設計 46
3.2.3 編譯 47
3.2.4 仿真 48
3.2.5 下載 54
3.3 基于IP核的設計 57
3.3.1 用原理圖方式實現 57
3.3.2 用文本例化ROM實現 63
3.4 SignalTap II的使用方法 63
3.5 Quartus
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數字系統設計與VHDL(第3版) 作者簡介
王金明，男，1972年5月出生，博士，現為解放軍陸軍工程大學副教授、碩士生導師。曾獲軍隊科技進步一等獎1項，軍隊科技進步二等獎3項，軍隊科技進步三等獎5項，獲軍隊級教學成果二等獎1項；獲國家發明專利授權2項，獲軟件著作授權1項；發表論文80余篇，其中SCI、EI收錄30余篇；主編教材多部，并入選"十一五”國家級規劃教材和"十二五”國家級規劃教材；2013年獲軍隊院校育才獎銀獎；2014年由國家留學基金委資助，在美國威斯康星大學麥迪遜分校訪問研究1年；指導本科生參加全國大學生電子設計競賽，共獲得全國一等獎8項。
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