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數(shù)字電路與HDL實(shí)現(xiàn) 版權(quán)信息
- ISBN：9787568943062
- 條形碼：9787568943062 ; 978-7-5689-4306-2
- 裝幀：一般膠版紙
- 冊(cè)數(shù)：暫無
- 重量：暫無
- 所屬分類：>>
數(shù)字電路與HDL實(shí)現(xiàn) 內(nèi)容簡(jiǎn)介
本書是“依托國(guó)家一流本科專業(yè)建設(shè)點(diǎn)的電子信息類虛擬教研室建設(shè)與探索研究”和一流課程建設(shè)的教學(xué)改革成果之一，結(jié)合電類專業(yè)創(chuàng)新型應(yīng)用人才培養(yǎng)目標(biāo)的需求而編寫。本書系統(tǒng)介紹了數(shù)字電路的基礎(chǔ)知識(shí)、傳統(tǒng)數(shù)字電路的分析、設(shè)計(jì)方法和基于EDA的現(xiàn)代數(shù)字系統(tǒng)設(shè)計(jì)方法，介紹了Verilog HDL語言在數(shù)字邏輯電路設(shè)計(jì)和數(shù)字系統(tǒng)設(shè)計(jì)方面的應(yīng)用。全書共10章，內(nèi)容主要包括：邏輯代數(shù)基礎(chǔ)、EDA技術(shù)基礎(chǔ)、基本邏輯門電路、組合邏輯電路、數(shù)字信號(hào)的存儲(chǔ)電路、時(shí)序邏輯電路、數(shù)字信號(hào)的產(chǎn)生電路、信號(hào)轉(zhuǎn)換電路和數(shù)字系統(tǒng)設(shè)計(jì)基礎(chǔ)等。本書可作為高等院校電子類、自動(dòng)化類、計(jì)算機(jī)類及其他相近專業(yè)的本科生教材或教學(xué)參考用書，也可供相關(guān)工程技術(shù)人員參考。
數(shù)字電路與HDL實(shí)現(xiàn) 目錄
第1章 概述
1.1 數(shù)字電子技術(shù)發(fā)展簡(jiǎn)史
1.2 模擬電路和數(shù)字電路
1.3 數(shù)字電路中的數(shù)制
1.4 數(shù)字電路中的代碼
本章小結(jié)
習(xí)題
第2章 邏輯代數(shù)基礎(chǔ)
2.1 3種基本邏輯運(yùn)算
2.2 邏輯代數(shù)的基本公式和常用公式
2.3 邏輯代數(shù)的基本定理
2.4 邏輯函數(shù)及表示方法
2.5 邏輯函數(shù)的化簡(jiǎn)方法
2.6 具有無關(guān)項(xiàng)的邏輯函數(shù)及化簡(jiǎn)
本章小結(jié)
習(xí)題
第3章 Verilog HDL語言基礎(chǔ)
3.1 Verilog HDL概述
3.2 Verilog HDL語言入門
3.3 Verilog HDL基本語法
3.4 Verilog HDL基本語句
本章小結(jié)
習(xí)題
第4章 基本的集成邏輯門電路
4.1 集成邏輯門電路的一般特性
4.2 TTL集成門電路
4.3 CMOS集成門電路
4.4 不同門電路之問的接口問題
4.5 基本門電路的HDL描述及仿真
本章小結(jié)
習(xí)題
第5章 組合邏輯電路
5.1 組合邏輯電路的特點(diǎn)及功能描述
5.2 基于SSI的組合邏輯電路的分析與設(shè)計(jì)
5.3 常用的MSI組合邏輯電路
5.4 基于MSI的組合邏輯電路的分析與設(shè)計(jì)
5.5 組合邏輯電路的競(jìng)爭(zhēng)-冒險(xiǎn)
5.6 組合邏輯電路的Verilog HDL描述及其仿真
本章小結(jié)
習(xí)題
第6章 數(shù)字信號(hào)的存儲(chǔ)電路
6.1 二進(jìn)制存儲(chǔ)單元
6.2 寄存器
6.3 半導(dǎo)體存儲(chǔ)器
6.4 觸發(fā)器的Verilog HDL描述及其仿真
本章小結(jié)
習(xí)題
第7章 時(shí)序邏輯電路
7.1 時(shí)序邏輯電路的特點(diǎn)及功能描述
7.2 時(shí)序邏輯電路的分析方法
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