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包郵 EDA技術(shù)及應(yīng)用 第2版
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EDA技術(shù)及應(yīng)用 第2版 版權(quán)信息
- ISBN：9787111697763
- 條形碼：9787111697763 ; 978-7-111-69776-3
- 裝幀：一般膠版紙
- 冊(cè)數(shù)：暫無(wú)
- 重量：暫無(wú)
- 所屬分類(lèi)：>
EDA技術(shù)及應(yīng)用 第2版 本書(shū)特色
本書(shū)取材廣泛，內(nèi)容新穎，理論聯(lián)系實(shí)際，章節(jié)結(jié)構(gòu)合理，前后知識(shí)點(diǎn)銜接流暢，適合于電氣類(lèi)、電子信息類(lèi)、自動(dòng)化類(lèi)、計(jì)算機(jī)類(lèi)各專(zhuān)業(yè)的學(xué)生選用
EDA技術(shù)及應(yīng)用 第2版 內(nèi)容簡(jiǎn)介
本書(shū)共6章，第1章講述了EDA技術(shù)的特點(diǎn)、概念和數(shù)字系統(tǒng)的設(shè)計(jì)方法；第2章介紹了VHDL的基本語(yǔ)法特點(diǎn)、程序結(jié)構(gòu)、常用語(yǔ)句以及相關(guān)基礎(chǔ)知識(shí)；第3章介紹了一些典型的基本門(mén)電路、組合邏輯電路和時(shí)序邏輯電路VHDL的實(shí)現(xiàn)方式；第4章介紹了Altera公司的綜合開(kāi)發(fā)軟件的特點(diǎn)和使用方法；第5章介紹了EDA技術(shù)的工程應(yīng)用案例；第6章列舉了20個(gè)基礎(chǔ)性和綜合性實(shí)驗(yàn)項(xiàng)目。本書(shū)可作為高等學(xué)校電氣類(lèi)、電子信息類(lèi)、自動(dòng)化類(lèi)、計(jì)算機(jī)類(lèi)本、專(zhuān)科專(zhuān)業(yè)的“EDA技術(shù)”課程的教材，亦可作為參加電子設(shè)計(jì)競(jìng)賽的培訓(xùn)教材和參考書(shū)，還可作為電子愛(ài)好者的自學(xué)教材。本書(shū)配有免費(fèi)電子課件，歡迎選用本書(shū)作為教材的老師登錄www.cmpedu.com注冊(cè)下載。
EDA技術(shù)及應(yīng)用 第2版 目錄
第1章 EDA技術(shù)概述
1.1 EDA技術(shù)的含義
1.2 EDA技術(shù)的發(fā)展歷程
1.3 EDA技術(shù)的主要內(nèi)容
1.4 EDA軟件系統(tǒng)的構(gòu)成
1.5 EDA的工程設(shè)計(jì)流程
1.6 數(shù)字系統(tǒng)的設(shè)計(jì)
1.6.1 數(shù)字系統(tǒng)的設(shè)計(jì)模型
1.6.2 數(shù)字系統(tǒng)的設(shè)計(jì)方法
1.6.3 數(shù)字系統(tǒng)的設(shè)計(jì)準(zhǔn)則
1.6.4 數(shù)字系統(tǒng)的設(shè)計(jì)步驟
習(xí)題
第2章 VHDL程序基礎(chǔ)
2.1 概述
2.2 VHDL程序的結(jié)構(gòu)
2.2.1 VHDL程序設(shè)計(jì)的基本單元
2.2.2 實(shí)體
2.2.3 構(gòu)造體
2.2.4 配置
2.3 VHDL設(shè)計(jì)資源
2.3.1 庫(kù)
2.3.2 包集合
2.4 VHDL要素
2.4.1 標(biāo)志符
2.4.2 數(shù)據(jù)對(duì)象
2.4.3 VHDL的數(shù)據(jù)類(lèi)型
2.4.4 VHDL運(yùn)算符
2.4.5 VHDL的屬性
2.4.6 常見(jiàn)錯(cuò)誤
2.5 VHDL的描述方式
2.5.1 行為描述
2.5.2 數(shù)據(jù)流描述
2.5.3 結(jié)構(gòu)描述
2.6 VHDL順序語(yǔ)句
2.6.1 賦值語(yǔ)句
2.6.2 轉(zhuǎn)向控制語(yǔ)句
2.6.3 等待語(yǔ)句
2.6.4 子程序調(diào)用語(yǔ)句
2.6.5 返回語(yǔ)句
2.6.6 空操作語(yǔ)句
2.6.7 其他語(yǔ)句
2.7 VHDL并行語(yǔ)句
2.7.1 進(jìn)程語(yǔ)句
2.7.2 塊語(yǔ)句
2.7.3 并行信號(hào)賦值語(yǔ)句
2.7.4 并行過(guò)程調(diào)用語(yǔ)句
2.7.5 元件例化語(yǔ)句
2.7.6 生成語(yǔ)句
2.8 子程序
2.8.1 函數(shù)
2.8.2 重載函數(shù)
2.8.3 過(guò)程
2.8.4 重載過(guò)程
習(xí)題
第3章 基本邏輯單元的VHDL模型
3.1 組合邏輯電路設(shè)計(jì)
3.1.1 基本邏輯門(mén)電路
3.1.2 編碼器、譯碼器和數(shù)據(jù)選擇器
3.1.3 加法器
3.1.4 三態(tài)門(mén)及總線緩沖器
3.1.5 運(yùn)算電路
3.2 時(shí)序邏輯電路設(shè)計(jì)
3.2.1 觸發(fā)器
3.2.2 寄存器
3.2.3 計(jì)數(shù)器
3.2.4 分頻器
3.2.5 序列信號(hào)發(fā)生器和檢測(cè)器
3.3 存儲(chǔ)器
3.3.1 存儲(chǔ)器描述中的一些共性問(wèn)題
3.3.2 只讀存儲(chǔ)器
3.3.3 隨機(jī)存儲(chǔ)器
3.3.4 堆棧
3.4 有限狀態(tài)機(jī)
3.4.1 有限狀態(tài)機(jī)的分類(lèi)
3.4.2 有限狀態(tài)機(jī)的應(yīng)用
習(xí)題
第4章 Quartus Ⅱ與ModelSim軟件及使用
4.1 半加器和全加器
4.2 半加器的實(shí)現(xiàn)與仿真
4.2.1 創(chuàng)建一個(gè)新工程
4.2.2 半加器設(shè)計(jì)
4.2.3 半加器的仿真
4.2.4 半加器的IP核輸入方式和VHDL輸入方式
4.3 一位全加器設(shè)計(jì)
4.3.1 基本的輸入方式
4.3.2 全加器的仿真
4.4 ModelSim批處理
習(xí)題
第5章 EDA技術(shù)工程應(yīng)用實(shí)例
5.1 跑馬燈SOPC實(shí)現(xiàn)
5.1.1 概述
5.1.2 片上RAM實(shí)現(xiàn)跑馬燈
5.1.3 外置并行Flash和SDRAM結(jié)構(gòu)實(shí)現(xiàn)跑馬燈
5.1.4 外置串行EPCS和并行SDRAM結(jié)構(gòu)實(shí)現(xiàn)跑馬燈
5.2 時(shí)間數(shù)字轉(zhuǎn)換器延時(shí)鏈的FPGA實(shí)現(xiàn)
5.2.1 時(shí)序電路的建立和保持時(shí)間
5.2.2 TDC延時(shí)鏈的構(gòu)建
5.2.3 TDC延時(shí)鏈的時(shí)序約束及時(shí)序分析
5.2.4 TDC延時(shí)鏈的SignalTap Ⅱ數(shù)據(jù)采集
習(xí)題
第6章 EDA技術(shù)實(shí)驗(yàn)
6.1 Quartus Ⅱ的使用
6.2 人表決器
6.3 格雷碼變換電路
6.4 BCD碼加法器
6.5 位全加器
6.6 英語(yǔ)字母顯示電路
6.7 位并行乘法器
6.8 設(shè)計(jì)基本觸發(fā)器
6.9 設(shè)計(jì)74LS160計(jì)數(shù)器功能模塊
6.10 步長(zhǎng)可變的加減計(jì)數(shù)器
6.11 可控脈沖發(fā)生器
6.12 正負(fù)脈寬數(shù)控調(diào)制信號(hào)發(fā)生器
6.13 序列檢測(cè)器
6.14 4位移位乘法器
6.15 出租車(chē)計(jì)費(fèi)器
6.16 數(shù)字秒表
6.17 頻率計(jì)
6.18 交通燈控制器
6.19 數(shù)碼鎖
6.20 乒乓球游戲機(jī)
參考文獻(xiàn)
1.1 EDA技術(shù)的含義
1.2 EDA技術(shù)的發(fā)展歷程
1.3 EDA技術(shù)的主要內(nèi)容
1.4 EDA軟件系統(tǒng)的構(gòu)成
1.5 EDA的工程設(shè)計(jì)流程
1.6 數(shù)字系統(tǒng)的設(shè)計(jì)
1.6.1 數(shù)字系統(tǒng)的設(shè)計(jì)模型
1.6.2 數(shù)字系統(tǒng)的設(shè)計(jì)方法
1.6.3 數(shù)字系統(tǒng)的設(shè)計(jì)準(zhǔn)則
1.6.4 數(shù)字系統(tǒng)的設(shè)計(jì)步驟
習(xí)題
第2章 VHDL程序基礎(chǔ)
2.1 概述
2.2 VHDL程序的結(jié)構(gòu)
2.2.1 VHDL程序設(shè)計(jì)的基本單元
2.2.2 實(shí)體
2.2.3 構(gòu)造體
2.2.4 配置
2.3 VHDL設(shè)計(jì)資源
2.3.1 庫(kù)
2.3.2 包集合
2.4 VHDL要素
2.4.1 標(biāo)志符
2.4.2 數(shù)據(jù)對(duì)象
2.4.3 VHDL的數(shù)據(jù)類(lèi)型
2.4.4 VHDL運(yùn)算符
2.4.5 VHDL的屬性
2.4.6 常見(jiàn)錯(cuò)誤
2.5 VHDL的描述方式
2.5.1 行為描述
2.5.2 數(shù)據(jù)流描述
2.5.3 結(jié)構(gòu)描述
2.6 VHDL順序語(yǔ)句
2.6.1 賦值語(yǔ)句
2.6.2 轉(zhuǎn)向控制語(yǔ)句
2.6.3 等待語(yǔ)句
2.6.4 子程序調(diào)用語(yǔ)句
2.6.5 返回語(yǔ)句
2.6.6 空操作語(yǔ)句
2.6.7 其他語(yǔ)句
2.7 VHDL并行語(yǔ)句
2.7.1 進(jìn)程語(yǔ)句
2.7.2 塊語(yǔ)句
2.7.3 并行信號(hào)賦值語(yǔ)句
2.7.4 并行過(guò)程調(diào)用語(yǔ)句
2.7.5 元件例化語(yǔ)句
2.7.6 生成語(yǔ)句
2.8 子程序
2.8.1 函數(shù)
2.8.2 重載函數(shù)
2.8.3 過(guò)程
2.8.4 重載過(guò)程
習(xí)題
第3章 基本邏輯單元的VHDL模型
3.1 組合邏輯電路設(shè)計(jì)
3.1.1 基本邏輯門(mén)電路
3.1.2 編碼器、譯碼器和數(shù)據(jù)選擇器
3.1.3 加法器
3.1.4 三態(tài)門(mén)及總線緩沖器
3.1.5 運(yùn)算電路
3.2 時(shí)序邏輯電路設(shè)計(jì)
3.2.1 觸發(fā)器
3.2.2 寄存器
3.2.3 計(jì)數(shù)器
3.2.4 分頻器
3.2.5 序列信號(hào)發(fā)生器和檢測(cè)器
3.3 存儲(chǔ)器
3.3.1 存儲(chǔ)器描述中的一些共性問(wèn)題
3.3.2 只讀存儲(chǔ)器
3.3.3 隨機(jī)存儲(chǔ)器
3.3.4 堆棧
3.4 有限狀態(tài)機(jī)
3.4.1 有限狀態(tài)機(jī)的分類(lèi)
3.4.2 有限狀態(tài)機(jī)的應(yīng)用
習(xí)題
第4章 Quartus Ⅱ與ModelSim軟件及使用
4.1 半加器和全加器
4.2 半加器的實(shí)現(xiàn)與仿真
4.2.1 創(chuàng)建一個(gè)新工程
4.2.2 半加器設(shè)計(jì)
4.2.3 半加器的仿真
4.2.4 半加器的IP核輸入方式和VHDL輸入方式
4.3 一位全加器設(shè)計(jì)
4.3.1 基本的輸入方式
4.3.2 全加器的仿真
4.4 ModelSim批處理
習(xí)題
第5章 EDA技術(shù)工程應(yīng)用實(shí)例
5.1 跑馬燈SOPC實(shí)現(xiàn)
5.1.1 概述
5.1.2 片上RAM實(shí)現(xiàn)跑馬燈
5.1.3 外置并行Flash和SDRAM結(jié)構(gòu)實(shí)現(xiàn)跑馬燈
5.1.4 外置串行EPCS和并行SDRAM結(jié)構(gòu)實(shí)現(xiàn)跑馬燈
5.2 時(shí)間數(shù)字轉(zhuǎn)換器延時(shí)鏈的FPGA實(shí)現(xiàn)
5.2.1 時(shí)序電路的建立和保持時(shí)間
5.2.2 TDC延時(shí)鏈的構(gòu)建
5.2.3 TDC延時(shí)鏈的時(shí)序約束及時(shí)序分析
5.2.4 TDC延時(shí)鏈的SignalTap Ⅱ數(shù)據(jù)采集
習(xí)題
第6章 EDA技術(shù)實(shí)驗(yàn)
6.1 Quartus Ⅱ的使用
6.2 人表決器
6.3 格雷碼變換電路
6.4 BCD碼加法器
6.5 位全加器
6.6 英語(yǔ)字母顯示電路
6.7 位并行乘法器
6.8 設(shè)計(jì)基本觸發(fā)器
6.9 設(shè)計(jì)74LS160計(jì)數(shù)器功能模塊
6.10 步長(zhǎng)可變的加減計(jì)數(shù)器
6.11 可控脈沖發(fā)生器
6.12 正負(fù)脈寬數(shù)控調(diào)制信號(hào)發(fā)生器
6.13 序列檢測(cè)器
6.14 4位移位乘法器
6.15 出租車(chē)計(jì)費(fèi)器
6.16 數(shù)字秒表
6.17 頻率計(jì)
6.18 交通燈控制器
6.19 數(shù)碼鎖
6.20 乒乓球游戲機(jī)
參考文獻(xiàn)
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