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基于FPGA的數(shù)字系統(tǒng)研究與設(shè)計 版權(quán)信息
- ISBN：9787030382931
- 條形碼：9787030382931 ; 978-7-03-038293-1
- 裝幀：一般膠版紙
- 冊數(shù)：暫無
- 重量：暫無
- 所屬分類：>>
基于FPGA的數(shù)字系統(tǒng)研究與設(shè)計 本書特色
本書從實用的角度出發(fā)，選擇系統(tǒng)級的fpga實現(xiàn)為書寫對象，全書詳細(xì)介紹了從雙核fft算法的基本原理到雙核fft核心的fpga實現(xiàn)，從單純fft處理器的實現(xiàn)過渡到fft應(yīng)用實例的開發(fā)，從簡單的數(shù)字系統(tǒng)的設(shè)計到復(fù)雜數(shù)字系統(tǒng)的設(shè)計。全書共分8章，從簡單的數(shù)字系統(tǒng)到復(fù)雜數(shù)字系統(tǒng)的開發(fā)，幫助讀者快速入門，同時提高讀者嵌入式系統(tǒng)開發(fā)的能力。
基于FPGA的數(shù)字系統(tǒng)研究與設(shè)計 內(nèi)容簡介
本書從實用的角度出發(fā)，選擇系統(tǒng)級的FPGA實現(xiàn)為書寫對象，全書詳細(xì)介紹了從雙核FFT算法的基本原理到雙核FFT核心的FPGA實現(xiàn)，從單純FFT處理器的實現(xiàn)過渡到FFT應(yīng)用實例的開發(fā)，從簡單的數(shù)字系統(tǒng)的設(shè)計到復(fù)雜數(shù)字系統(tǒng)的設(shè)計。全書共分8章，從簡單的數(shù)字系統(tǒng)到復(fù)雜數(shù)字系統(tǒng)的開發(fā)，幫助讀者快速入門，同時提高讀者嵌入式系統(tǒng)開發(fā)的能力。
基于FPGA的數(shù)字系統(tǒng)研究與設(shè)計 目錄
前言第1章 概述 1.1 CPLD／FPGA簡介 1.1.1 CPLD／FPGA的結(jié)構(gòu)與工作原理 1.1.2 CPLD／FPGA的發(fā)展趨勢 1.2 CPLD／FPGA產(chǎn)品概述 1.2.1 Lattice公司的CPLD器件系列 1.2.2 Xilinx公司的CPLD／FPGA器件系列 1.2.3 Altera的CPLD／FPGA器件系列 1.2.4 Altera公司的FPGA配置方式與配置器件第2章 項目開發(fā)環(huán)境介紹 2.1 軟件平臺 2.1.1 硬件開發(fā)工具QuartusⅡ12.0 2.1.2 ModelSim仿真工具 2.1.3 Nios Ⅱ IDE 8.0集成開發(fā)環(huán)境 2.1.4 Eclipse集成開發(fā)環(huán)境 2.1.5 數(shù)值計算與仿真測試工具MATLAB 2.2 硬件平臺 2.2.1 DE2平臺簡介 2.2.2 DE2原理 2.2.3 DE2平臺的開發(fā)環(huán)境 2.2.4 DE2開發(fā)板測試說明第3章 SOPC系統(tǒng)設(shè)計分析 3.1 SOPC技術(shù)簡介 3.1.1 SOPC技術(shù)的主要特點 3.1.2 SOPC技術(shù)實現(xiàn)方式 3.1.3 SOPC系統(tǒng)的開發(fā)流程 3.2 Nios Ⅱ概述 3.2.1 Nios Ⅱ嵌入式處理器 3.2.2 Nios Ⅱ處理器的特性 3.3 基于SOPC的Nios Ⅱ處理器設(shè)計 3.3.1 SOPC Builder功能 3.3.2 SOPC Builder組成 3.3.3 SOPC Builder組件 3.4 SOPC設(shè)計講解 3.4.1 硬件部分設(shè)計 3.4.2 軟件部分設(shè)計第4章 基于FPGA的OFDM系統(tǒng)基帶數(shù)據(jù)傳輸部分的設(shè)計與實現(xiàn) 4.1 實例介紹 4.2 設(shè)計思路與原理 4.2.1 OFDM技術(shù)簡介 4.2.2 OFDM系統(tǒng)基本原理 4.2.3 FFT算法原理 4.2.4 0FDM系統(tǒng)整體設(shè)計 4.3 硬件設(shè)計 4.3.1 邏輯模塊設(shè)計 4.3.2 詳細(xì)設(shè)計 4.3.3 OFDM系統(tǒng)的仿真及驗證 4.4 實例總結(jié)第5章 一種基于FPGA的超聲波測距系統(tǒng)的設(shè)計與實現(xiàn) 5.1 實例介紹 5.2 設(shè)計思路與原理 5.2.1 超聲波測距原理簡介 5.2.2 HC.SR04模塊簡介 5.2.3 超聲波傳感器工作原理 5.2.4 FFT算法原理 5.2.5 2D-FFT簡介 5.2.6 系統(tǒng)總體結(jié)構(gòu) 5.3 硬件設(shè)計 5.3.1 時序發(fā)生器模塊 5.3.2 回波識別模塊 5.3.3 雙核FFT計算模塊 5.3.4 波形發(fā)生器模塊 5.3.5 高速計數(shù)器模塊 5.4 系統(tǒng)綜合與測試 5.5 實例總結(jié)第6章 基于FPGA的云存儲架構(gòu)的設(shè)計與實現(xiàn) 6.1 實例介紹 6.2 設(shè)計思路與原理 6.2.1 云存儲通信原理 6.2.2 FPGA集群技術(shù)的原理 6.2.3 基于FPGA分布式存儲的原理 6.3 詳細(xì)設(shè)計 6.3.1 云存儲架構(gòu)設(shè)計 6.3.2 云存儲模塊設(shè)計與集成 6.3.3 云存儲架構(gòu)交互軟件 6.4 系統(tǒng)綜合與仿真測試 6.4.1 FPGA模塊測試 6.4.2 系統(tǒng)整體測試 6.5 實例總結(jié)第7章 基于FPGA的實時加／解密系統(tǒng)的設(shè)計與實現(xiàn) 7.1 實例介紹 7.2 設(shè)計思路與原理 7.2.1 AES算法簡介 7.2.2 AES加／解密流程 7.2.3 系統(tǒng)整體結(jié)構(gòu).
7.3 硬件設(shè)計 7.3.1 AES IP核設(shè)計 7.3.2 SOPC系統(tǒng)的創(chuàng)建 7.4 軟件設(shè)計與綜合測試 7.4.1 軟件設(shè)計 7.4.2 系統(tǒng)綜合與仿真測試 7.5 實例總結(jié)第8章 基于FPGA的藍(lán)牙智能小車的設(shè)計與實現(xiàn) 8.1 實例介紹 8.2 設(shè)計思路與原理 8.2.1 控制平臺和設(shè)計語言簡介 8.2.2 藍(lán)牙通信技術(shù)介紹 8.2.3 系統(tǒng)整體結(jié)構(gòu) 8.3 硬件設(shè)計 8.3.1 電機驅(qū)動模塊的設(shè)計 8.3.2 超聲波測距模塊的設(shè)計 8.3.3 藍(lán)牙模塊的設(shè)計 8.4 軟件設(shè)計與綜合測試 8.4.1 軟件設(shè)計 8.4.2 系統(tǒng)綜合與仿真測試 8.5 實例總結(jié)附錄 DE2平臺上EP2C35F672的引腳分配表參考文獻
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