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CPLD/FPGA設計及應用 版權信息
- ISBN：9787568011150
- 條形碼：9787568011150 ; 978-7-5680-1115-0
- 裝幀：一般膠版紙
- 冊數：暫無
- 重量：暫無
- 所屬分類：>
CPLD/FPGA設計及應用 內容簡介
本書從實際應用角度出發，其內容從EDA的概念到可編程邏輯器件的引入；從Quartus II軟件的安裝到低密度邏輯器件的設計；從硬件描述語言到數字邏輯電路的設計；結合案例掌握復雜可編程邏輯器件的設計方法；掌握各類工程模塊電路的設計方法，從圖形設計輸入、編譯、軟件仿真、下載和硬件測試等全過程；熟悉模塊電路的特性及典型應用。 本書適合高等本科院校通信工程、電子信息類、計算機應用類等相關專業的教材或參考書，也可作為工程技術人員的參考書。
CPLD/FPGA設計及應用 目錄
**章 概述
了解： EDA技術與硬件描述語言及其發展過程；EDA常用工具及其VHDL設計流程
理解：理解EDA、ASIC的概念
掌握：EDA技術的設計流程
重點內容：EDA、ASIC的概念；VHDL設計流程
教學難點：綜合，適配，時序仿真和功能仿真
1.1 EDA技術的涵義
知識點： EDA技術的涵義
1.2 EDA技術的發展歷程
知識點：EDA技術發展史
1.3 EDA技術的主要內容
知識點： 硬件描述語言、Quartus II概述、FPGA/CPLD器件概述
1.4 EDA的工程設計流程
知識點：設計輸入，綜合，適配，時序仿真和功能仿真，編程下載，硬件測試。
第二章 可編程邏輯器件
了解：可編程邏輯器件的發展，數字ASIC的分類
理解：可編程邏輯器件分類
掌握：可編程邏輯器件的基本結構
重點內容：復雜高密度PLD的基本結構
教學難點：簡單低密度PLD的基本結構，復雜高密度PLD的基本結構
2.1 專用集成電路設計與可編程邏輯器件
知識點：PLD簡述
2.2 可編程邏輯器件分類
知識點PLD的分類。
2.3 可編程邏輯器件的發展歷程
知識點：PROM，PLA，PAL，GAL
2.4 可編程邏輯器件的基本結構
知識點：PROM，PLA，PAL，GAL基本編程結構
2.5 CPLD的結構與可編程原理
知識點：CPLD的結構與可編程原理
2.6 FPGA的結構與工作原理
知識點：FPGA的結構與工作原理
2.7 編程與配置
知識點：JTAG方式的在系統編程，使用PC并行口配置FPGA，FPGA配置器件
第三章 VHDL硬件描述語言
了解： VHDL語言特點
理解： VHDL的程序結構
掌握： VHDL的語言元素，VHDL的基本語句
重點內容： VHDL的基本語句
教學難點：信號和變量的不同，進程語句，并行賦值語句，元件調用語句，生成語句，
3.1 VHDL概述
知識點：什么是VHDL，VHDL的歷史，VHDL的作用，VHDL語言特點
3.2 VHDL程序基本結構
知識點：VHDL的程序結構，VHDL的語言元素，實體，結構體，配置，程序包，庫，VHDL文字規則，對象，數據類型，運算操作符
3.3 庫、程序包及其他
知識點：程序包，庫
3.4 VHDL語言要素
知識點：VHDL文字規則，對象，數據類型，運算操作符
3.5 VHDL順序語句
知識點：VHDL的順序語句，IF語句，CASE語句，LOOP語句，NEXT語句，EXIT語句，RETURN語句，NULL語句
3.6 VHDL并行語句
知識點：VHDL的并行語句，進程語句，WAIT語句，BLOCK語句，并行賦值語句，元件調用語句，生成語句
第四章 QuartusⅡ使用方法
了解：QuartusⅡ
理解：實例分析
掌握：QuartusⅡ設計輸入方法
重點內容：QuartusⅡ設計輸入方法
教學難點：QuartusⅡ設計輸入方法、宏功能模塊
4.1 QuartusⅡ簡介
4.2 QuartusⅡ原理圖輸入設計方法
4.3 QuartusⅡ文本輸入設計方法
4.4 QuartusⅡ混合輸入方法
4.5 QuartusⅡ使用宏功能模塊設計方法
第5章 有限狀態機的VHDL設計（6學時）
了解：非法狀態處理
理解：狀態機結構
掌握：Moore狀態機，Mealy狀態機
重點內容：Moore狀態機，Mealy狀態機
教學難點：Moore狀態機，Mealy狀態機實例分析
5.1 有限狀態機的基本結構和功能
知識點：類型定義語句，狀態機的優勢，狀態機結構
5.2 一般有限狀態機的VHDL組成
知識點：狀態機的VHDL語法結構
5.3 摩爾狀態機設計
知識點：多進程狀態機，單進程Moore狀態機
5.4 米立狀態機設計
知識點：Mealy性有限狀態機的設計
5.5 狀態機編碼
知識點：狀態機的三種編碼方式
第六章 設計實例分析
6.1 基本組合邏輯電路的設計
知識點：數字電路邏輯中所有的基本組合邏輯電路用VHDL語言文本編輯的方式實現，進行功能仿真。
6.2 時序邏輯電路設計
知識點：時序邏輯電路設計用VHDL文本編輯方式實現，進行功能仿真。
6.3 后面可以增加一些典型的例子
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