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高速數字設計 版權信息
- ISBN：9787121104701
- 條形碼：9787121104701 ; 978-7-121-10470-1
- 裝幀：暫無
- 冊數：暫無
- 重量：暫無
- 所屬分類：>>
高速數字設計 本書特色
《高速數字設計》將理論與實踐方法相結合，適合從事模擬和數字電路設計的相關人員使用，可作為大專院校相關專業師生的教學參考，同時也適合體系結構設計人員、EMC專家、印刷電路板設計和布線專業人士閱讀。《高速數字設計》特點：涵蓋高速數字設備（20MHz到20GHz及更高）中發生的信號反射、串擾和噪聲問題；包括了經驗豐富的設計人員面對一個新系統時應該提出的一系列問題；提供了關于電感、電容、電阻、上升時間和Q值的計算公式，很有價值；解釋了如何在信號串擾、機械裝配公差和走線密度之間進行折中；介紹了在印制電路板走線時確定層數的方法。
高速數字設計 內容簡介
本書是信號完整性領域的一部經典著作。全書結合了數字和模擬電路理論，對高速數字電路系統設計中的信號完整性和emc方面的問題進行了深入淺出的討論和研究，其中不僅包括關于高速數字設計中emc方面的許多實用信息，還包括許多有價值的測試技術。另外，書中詳細討論了涉及信號完整性方面的傳輸線、時鐘偏移和抖動、端接、過孔等問題，具有極高的實踐指導意義。本書通俗易懂，理論與實踐方法結合緊密，是高速數字設計人員**參考書。
高速數字設計 目錄
第1章 基礎知識
1.1 頻率與時間
1.2 時間與距離
1.3 集總與分布系統
1.4 關于3 db和rms頻率的解釋
1.5 4種類型的電抗
1.6 普通電容
1.7 普通電感
1.8 估算衰減時間的更好方法
1.8.1 測量一個響應曲線下的總面積
1.8.2 應用到圖1.15中
1.9 互容
1.9.1 互容與串擾的關系
1.9.2 端接電阻之間的互容
1.10 互感 23
1.10.1 互感與串擾的關系
1.10.2 磁耦合環路的反向
1.10.3 容性耦合與感性耦合的比率
第2章 邏輯門電路的高速特性
2.1 一種年代久遠的數字技術的發展歷史
2.2 功率
2.2.1 靜態和動態功耗
2.2.2 驅動容性負載時的動態功耗
2.2.3 疊加偏置電流產生的動態功耗
2.2.4 輸入功率
2.2.5 內部功耗
2.2.6 驅動電路功耗
2.2.7 輸出功耗
2.3 速度
2.3.1 電壓突變的影響，dv/dt
2.3.2 電流突變的影響，di/dt
2.3.3 電壓容限
2.4 封裝
2.4.1 引腳電感
2.4.2 引腳電容
2.4.3 熱傳導（qjc和qca）
第3章 測量技術
3.1 示波器探頭的上升時間和帶寬
3.2 探頭接地環路的自感
3.2.1 計算接地環路電感
3.2.2 算出10%~90%上升時間
3.2.3 估算電路的q值
3.2.4 結果的重要性
3.3 探頭接地環路檢測到的假信號
3.3.1 環路a的變化電流
3.3.2 環路a和環路b的互感
3.3.3 應用互感的定義
3.3.4 磁場檢測器
3.4 探頭是如何加重電路負載的
3.5 特殊的探頭構造
3.5.1 自制的21:1探頭
3.5.2 低電感接地環路的夾具
3.5.3 嵌入式探測夾具
3.6 避免檢測到來自探頭外殼電流的信號
3.7 觀測一個串行數據傳輸系統
3.8 降低系統時鐘
3.9 觀測串擾
3.9.1 關掉原始信號
3.9.2 關掉串擾
3.9.3 產生人為的串擾
3.10 測量工作容限
3.10.1 附加噪聲
3.10.2 寬總線的時序調整
3.10.3 電源
3.10.4 溫度
3.10.5 數據吞吐量
3.11 觀察亞穩態
3.11.1 測量亞穩態
3.11.2 理解亞穩態的特性
3.11.3 長判決時間的證據
3.11.4 亞穩態問題的解決方法
第4章 傳輸線
第5章 地平面和疊層
第6章 端接
第7章 通孔
第8章 電源系統
第9章 連接器
第10章 扁平電纜 254
第11章 時鐘分配
第12章 時鐘振蕩器
附錄a 記憶要點
附錄b 計算上升時間
附錄c mathcad公式
參考書目
索引（中英文對照）
1.1 頻率與時間
1.2 時間與距離
1.3 集總與分布系統
1.4 關于3 db和rms頻率的解釋
1.5 4種類型的電抗
1.6 普通電容
1.7 普通電感
1.8 估算衰減時間的更好方法
1.8.1 測量一個響應曲線下的總面積
1.8.2 應用到圖1.15中
1.9 互容
1.9.1 互容與串擾的關系
1.9.2 端接電阻之間的互容
1.10 互感 23
1.10.1 互感與串擾的關系
1.10.2 磁耦合環路的反向
1.10.3 容性耦合與感性耦合的比率
第2章 邏輯門電路的高速特性
2.1 一種年代久遠的數字技術的發展歷史
2.2 功率
2.2.1 靜態和動態功耗
2.2.2 驅動容性負載時的動態功耗
2.2.3 疊加偏置電流產生的動態功耗
2.2.4 輸入功率
2.2.5 內部功耗
2.2.6 驅動電路功耗
2.2.7 輸出功耗
2.3 速度
2.3.1 電壓突變的影響，dv/dt
2.3.2 電流突變的影響，di/dt
2.3.3 電壓容限
2.4 封裝
2.4.1 引腳電感
2.4.2 引腳電容
2.4.3 熱傳導（qjc和qca）
第3章 測量技術
3.1 示波器探頭的上升時間和帶寬
3.2 探頭接地環路的自感
3.2.1 計算接地環路電感
3.2.2 算出10%~90%上升時間
3.2.3 估算電路的q值
3.2.4 結果的重要性
3.3 探頭接地環路檢測到的假信號
3.3.1 環路a的變化電流
3.3.2 環路a和環路b的互感
3.3.3 應用互感的定義
3.3.4 磁場檢測器
3.4 探頭是如何加重電路負載的
3.5 特殊的探頭構造
3.5.1 自制的21:1探頭
3.5.2 低電感接地環路的夾具
3.5.3 嵌入式探測夾具
3.6 避免檢測到來自探頭外殼電流的信號
3.7 觀測一個串行數據傳輸系統
3.8 降低系統時鐘
3.9 觀測串擾
3.9.1 關掉原始信號
3.9.2 關掉串擾
3.9.3 產生人為的串擾
3.10 測量工作容限
3.10.1 附加噪聲
3.10.2 寬總線的時序調整
3.10.3 電源
3.10.4 溫度
3.10.5 數據吞吐量
3.11 觀察亞穩態
3.11.1 測量亞穩態
3.11.2 理解亞穩態的特性
3.11.3 長判決時間的證據
3.11.4 亞穩態問題的解決方法
第4章 傳輸線
第5章 地平面和疊層
第6章 端接
第7章 通孔
第8章 電源系統
第9章 連接器
第10章 扁平電纜 254
第11章 時鐘分配
第12章 時鐘振蕩器
附錄a 記憶要點
附錄b 計算上升時間
附錄c mathcad公式
參考書目
索引（中英文對照）
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高速數字設計 節選
《高速數字設計》是信號完整性領域的一部經典著作，其英文版已重印超過20次。全書結合了數字和模擬電路理論，對高速數字電路系統設計中的信號完整性和EMC方面的問題進行了深入淺出的討論和研究，其中不僅包括關于高速數字設計中EMC方面的許多實用信息，還包括許多有價值的測試技術。另外，書中詳細討論了涉及信號完整性方面的傳輸線、時鐘偏移和抖動、端接、過孔等問題。《高速數字設計》綜合了數字和模擬設計技術，對數字電路設計人員提高設計技能、縮短其產品的開發周期、精通信號完整性技術等都大有裨益。《高速數字設計》通俗易懂，是高速數字設計人員的**參考書，實用性很強，獨特地將理論與實踐方法相結合，適合從事模擬和數字電路設計的相關人員使用。《高速數字設計》可作為大專院校相關專業師生的教學參考，對于體系結構設計人員、EMC專家、印刷電路板設計和布線專業人士也是一本極具價值的參考書。
高速數字設計 作者簡介
Howard Johnson，1982年在美國萊斯大學獲得博士學位后專攻高速數字通信和數字信號處理系統的設計，在數字設計領域有近50年的經驗，一直從節數字電子設計和咨詢業務，服務于全球的數字工程師，并在英國牛津大學授課。
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