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數(shù)字電路 版權(quán)信息
- ISBN：9787307064652
- 條形碼：9787307064652 ; 978-7-307-06465-2
- 裝幀：暫無
- 冊數(shù)：暫無
- 重量：暫無
- 所屬分類：>>
數(shù)字電路 內(nèi)容簡介
本書內(nèi)容遵循“以實(shí)用為主，理論夠用為度”的原則，注重突出實(shí)用性。為適應(yīng)當(dāng)前電子技術(shù)人才培養(yǎng)的迫切要求，教材介紹了數(shù)字電路的基礎(chǔ)知識和常規(guī)內(nèi)容，同時(shí)還介紹了數(shù)字電子技術(shù)的新器件、新技術(shù)等方面內(nèi)容，其中包括常用中、大規(guī)模數(shù)字集成電路的分析與應(yīng)用，各類常用器件的測試技能等。
全書共分8章，包括數(shù)字電路基礎(chǔ)、基本邏輯門電路、組合邏輯電路、觸發(fā)器、時(shí)序邏輯電路、脈沖波形的產(chǎn)生與整形、模擬量和數(shù)字量的轉(zhuǎn)換，以及半導(dǎo)體儲存器等。
本書深入淺出，重點(diǎn)明確，實(shí)例豐富。可作為高校電子、通信、光電、計(jì)算機(jī)、電氣及自動化等專業(yè)的專業(yè)基礎(chǔ)課教材，尤其適合獨(dú)立院校電子信息類專業(yè)，也可供從事電子技術(shù)工作的工程技術(shù)人員參考。相關(guān)專業(yè)的《數(shù)字邏輯》課程也可使用本教材。
數(shù)字電路 目錄
**章：數(shù)字電路基礎(chǔ)
1.1 模擬與數(shù)字信號
1.1.1 模擬信號
1.1.2 數(shù)字信號
1.2 數(shù)制與碼制
1.2.1 十進(jìn)制
1.2.2 二進(jìn)制
1.2.3 進(jìn)制轉(zhuǎn)換
1.2.4 二進(jìn)制編碼
習(xí)題1
第二章：基本邏輯門電路
2.1 基本邏輯運(yùn)算
2.1.1 與、或、非邏輯運(yùn)算
2.1.2 其他邏輯運(yùn)算
2.1.3 邏輯函數(shù)
2.1.4 正負(fù)邏輯
2.2 分立元件門電路
2.2.1 二極管與門電路
2.2.2 二極管或門電路
2.2.3 二極管非門電路
2.3 集成TTL門電路
2.3.1 TTL與非門電路
2.3.2 TTL與非門的主要技術(shù)參數(shù)
2.3.3 集電極開路與非門和三態(tài)輸出與非門
2.3.4 其他類型的TTL門電路
2.3.5T TL集成邏輯門電路系列簡介
2.4 集成CMOS電路
2.4.1 CMOS反相器
2.4.2 CMOS與非門
2.4.3 CMOS漏極開路門（OD門）
2.4.4 CMOS傳輸門
2.4.5 CMOS邏輯門電路的系列及主要參數(shù)
2.5 門電路的接口
2.5.1 TTL門驅(qū)動和CMOS門
2.5.2 CMOS門驅(qū)動TTL門
2.5.3 TTL和CMOS電路帶負(fù)載時(shí)的接口問題
2.5.4 多余輸入端的處理
習(xí)題2
第三章：組合邏輯電路
3.1 邏輯函數(shù)的代數(shù)化簡
3.1.1 布爾代數(shù)（邏輯代數(shù)）
3.1.2 邏輯函數(shù)的布爾代數(shù)化簡
3.2 邏輯函數(shù)的卡諾圖化簡
3.2.1 邏輯函數(shù)的*小項(xiàng)表達(dá)式
3.2.2 邏輯函數(shù)的卡諾圖表示
3.2.3 邏輯函數(shù)的卡諾圖化簡
3.3 組合邏輯函數(shù)的分析與設(shè)計(jì)
3.3.1 組合電路特點(diǎn)和數(shù)字描述
3.3.2 組合邏輯電路的分析
3.3.3 組合邏輯電路的設(shè)計(jì)
3.4 常用組合邏輯器件
3.4.1 編碼器
3.4.2 譯碼器
3.4.3 數(shù)據(jù)選擇器
3.4.4 數(shù)據(jù)分配器
3.4.5 數(shù)據(jù)比較器
3.4.6 半加器與全加器
3.5 組合邏輯電路中的競爭與冒險(xiǎn)
習(xí)題3
第四章：觸發(fā)器
4.1 基本RS觸發(fā)器
4.1.1 基本RS觸發(fā)器的工作原理
4.1.2 基本RS觸發(fā)器的功能
4.2 同步觸發(fā)器
4.2.1 基本RS觸發(fā)器
4.2.2 基本D觸發(fā)器
4.2.3 基本JK觸發(fā)器
4.2.4 基本T觸發(fā)器
4.2.5 同步觸發(fā)器存在的問題——空翻
4.3 主從觸發(fā)器
4.3.1 主從RS觸發(fā)器
4.3.2 主從JK觸發(fā)器
4.3.3 T觸發(fā)器和T觸發(fā)器
4.4 邊沿觸發(fā)器
4.4.1 維持—阻塞邊沿D觸發(fā)器
4.4.2 下降沿觸發(fā)的JK觸發(fā)器
4.4.3 COMS主從結(jié)構(gòu)的邊沿觸發(fā)器
4.5 集成觸發(fā)器
4.5.1 集成觸發(fā)器舉例
4.5.2 觸發(fā)器功能轉(zhuǎn)換
4.5.3 集成觸發(fā)器的脈沖工作特性和主要指標(biāo)
練習(xí)4
第五章：時(shí)序邏輯電路
5.1 時(shí)序邏輯電路概述
5.1.1 時(shí)序邏輯電路的結(jié)構(gòu)特點(diǎn)
5.1.2 時(shí)序邏輯電路的分類
5.1.3 時(shí)序邏輯電路的表示方法
5.1.4 時(shí)序邏輯電路的分析方法
5.2 計(jì)數(shù)器
5.2.1 二進(jìn)制計(jì)數(shù)器
5.2.2 非二進(jìn)制計(jì)數(shù)器
5.2.3 集成計(jì)數(shù)器74LS90,74LS160,74LS161,74LS162,74,LS163
5.3 寄存器
5.3.1 數(shù)碼寄存器
5.3.2 位移寄存器
5.3.3 集成寄存器74LS175,74LS194
習(xí)題5
第六章：脈沖波形的產(chǎn)生與整形
6.1 多諧振蕩器
6.1.1 多諧振蕩器電路原理
6.1.2 石英晶體振蕩器
6.2 單穩(wěn)態(tài)觸發(fā)器
6.2.1 微分單型穩(wěn)態(tài)觸發(fā)器
6.2.2 集成單穩(wěn)態(tài)觸發(fā)器
6.2.3 單穩(wěn)態(tài)觸發(fā)器的應(yīng)用
6.3 施密特觸發(fā)器
6.3.1 施密特觸發(fā)器的電路組成和工作原理
6.3.2 集成施密特觸發(fā)器及其應(yīng)用
6.4 555定時(shí)器及其應(yīng)用
6.4.1 555定時(shí)器的內(nèi)部結(jié)構(gòu)
6.4.2 555定時(shí)器的應(yīng)用
習(xí)題6
第七章：模擬量和數(shù)字量的轉(zhuǎn)換
7.1 D/A轉(zhuǎn)換器
7.1.1 倒T型電阻網(wǎng)絡(luò)D/A轉(zhuǎn)換器
7.1.2 倒轉(zhuǎn)換器的主要技術(shù)指標(biāo)
7.1.3 集成D/A轉(zhuǎn)換器AD7520，ADC0832及其應(yīng)用
7.2 ADC轉(zhuǎn)換器
7.2.1 逐次逼近型A/D轉(zhuǎn)換器的工作原理
7.2.2 A/D轉(zhuǎn)換器的主要技術(shù)指標(biāo)
7.2.3 集成ADC轉(zhuǎn)換器ADC0809及其應(yīng)用
習(xí)題7
第八章：半導(dǎo)體儲存器
8.1 隨機(jī)儲存器（RAM）
8.1.1 RAM結(jié)構(gòu)和工作原理
8.1.2 RAM的工作時(shí)序圖
8.1.3 RAM的的儲存容量擴(kuò)張
8.1.4 常用集成RAM
8.2 只讀儲存器（ROM）
8.2.1 MROM電路結(jié)構(gòu)原理
8.2.2 PROM電路結(jié)構(gòu)原理
8.2.3 EPROM電路結(jié)構(gòu)原理
8.2.4 EPROM電路結(jié)構(gòu)原理
習(xí)題8
附錄A 美國標(biāo)準(zhǔn)信息交換碼（ASCII）
附錄B 二進(jìn)制數(shù)算術(shù)運(yùn)算
附錄C TTL和COMS邏輯門電路的技術(shù)參考
附錄D 常用邏輯符號對照表
附錄E 習(xí)題參考答案
1.1 模擬與數(shù)字信號
1.1.1 模擬信號
1.1.2 數(shù)字信號
1.2 數(shù)制與碼制
1.2.1 十進(jìn)制
1.2.2 二進(jìn)制
1.2.3 進(jìn)制轉(zhuǎn)換
1.2.4 二進(jìn)制編碼
習(xí)題1
第二章：基本邏輯門電路
2.1 基本邏輯運(yùn)算
2.1.1 與、或、非邏輯運(yùn)算
2.1.2 其他邏輯運(yùn)算
2.1.3 邏輯函數(shù)
2.1.4 正負(fù)邏輯
2.2 分立元件門電路
2.2.1 二極管與門電路
2.2.2 二極管或門電路
2.2.3 二極管非門電路
2.3 集成TTL門電路
2.3.1 TTL與非門電路
2.3.2 TTL與非門的主要技術(shù)參數(shù)
2.3.3 集電極開路與非門和三態(tài)輸出與非門
2.3.4 其他類型的TTL門電路
2.3.5T TL集成邏輯門電路系列簡介
2.4 集成CMOS電路
2.4.1 CMOS反相器
2.4.2 CMOS與非門
2.4.3 CMOS漏極開路門（OD門）
2.4.4 CMOS傳輸門
2.4.5 CMOS邏輯門電路的系列及主要參數(shù)
2.5 門電路的接口
2.5.1 TTL門驅(qū)動和CMOS門
2.5.2 CMOS門驅(qū)動TTL門
2.5.3 TTL和CMOS電路帶負(fù)載時(shí)的接口問題
2.5.4 多余輸入端的處理
習(xí)題2
第三章：組合邏輯電路
3.1 邏輯函數(shù)的代數(shù)化簡
3.1.1 布爾代數(shù)（邏輯代數(shù)）
3.1.2 邏輯函數(shù)的布爾代數(shù)化簡
3.2 邏輯函數(shù)的卡諾圖化簡
3.2.1 邏輯函數(shù)的*小項(xiàng)表達(dá)式
3.2.2 邏輯函數(shù)的卡諾圖表示
3.2.3 邏輯函數(shù)的卡諾圖化簡
3.3 組合邏輯函數(shù)的分析與設(shè)計(jì)
3.3.1 組合電路特點(diǎn)和數(shù)字描述
3.3.2 組合邏輯電路的分析
3.3.3 組合邏輯電路的設(shè)計(jì)
3.4 常用組合邏輯器件
3.4.1 編碼器
3.4.2 譯碼器
3.4.3 數(shù)據(jù)選擇器
3.4.4 數(shù)據(jù)分配器
3.4.5 數(shù)據(jù)比較器
3.4.6 半加器與全加器
3.5 組合邏輯電路中的競爭與冒險(xiǎn)
習(xí)題3
第四章：觸發(fā)器
4.1 基本RS觸發(fā)器
4.1.1 基本RS觸發(fā)器的工作原理
4.1.2 基本RS觸發(fā)器的功能
4.2 同步觸發(fā)器
4.2.1 基本RS觸發(fā)器
4.2.2 基本D觸發(fā)器
4.2.3 基本JK觸發(fā)器
4.2.4 基本T觸發(fā)器
4.2.5 同步觸發(fā)器存在的問題——空翻
4.3 主從觸發(fā)器
4.3.1 主從RS觸發(fā)器
4.3.2 主從JK觸發(fā)器
4.3.3 T觸發(fā)器和T觸發(fā)器
4.4 邊沿觸發(fā)器
4.4.1 維持—阻塞邊沿D觸發(fā)器
4.4.2 下降沿觸發(fā)的JK觸發(fā)器
4.4.3 COMS主從結(jié)構(gòu)的邊沿觸發(fā)器
4.5 集成觸發(fā)器
4.5.1 集成觸發(fā)器舉例
4.5.2 觸發(fā)器功能轉(zhuǎn)換
4.5.3 集成觸發(fā)器的脈沖工作特性和主要指標(biāo)
練習(xí)4
第五章：時(shí)序邏輯電路
5.1 時(shí)序邏輯電路概述
5.1.1 時(shí)序邏輯電路的結(jié)構(gòu)特點(diǎn)
5.1.2 時(shí)序邏輯電路的分類
5.1.3 時(shí)序邏輯電路的表示方法
5.1.4 時(shí)序邏輯電路的分析方法
5.2 計(jì)數(shù)器
5.2.1 二進(jìn)制計(jì)數(shù)器
5.2.2 非二進(jìn)制計(jì)數(shù)器
5.2.3 集成計(jì)數(shù)器74LS90,74LS160,74LS161,74LS162,74,LS163
5.3 寄存器
5.3.1 數(shù)碼寄存器
5.3.2 位移寄存器
5.3.3 集成寄存器74LS175,74LS194
習(xí)題5
第六章：脈沖波形的產(chǎn)生與整形
6.1 多諧振蕩器
6.1.1 多諧振蕩器電路原理
6.1.2 石英晶體振蕩器
6.2 單穩(wěn)態(tài)觸發(fā)器
6.2.1 微分單型穩(wěn)態(tài)觸發(fā)器
6.2.2 集成單穩(wěn)態(tài)觸發(fā)器
6.2.3 單穩(wěn)態(tài)觸發(fā)器的應(yīng)用
6.3 施密特觸發(fā)器
6.3.1 施密特觸發(fā)器的電路組成和工作原理
6.3.2 集成施密特觸發(fā)器及其應(yīng)用
6.4 555定時(shí)器及其應(yīng)用
6.4.1 555定時(shí)器的內(nèi)部結(jié)構(gòu)
6.4.2 555定時(shí)器的應(yīng)用
習(xí)題6
第七章：模擬量和數(shù)字量的轉(zhuǎn)換
7.1 D/A轉(zhuǎn)換器
7.1.1 倒T型電阻網(wǎng)絡(luò)D/A轉(zhuǎn)換器
7.1.2 倒轉(zhuǎn)換器的主要技術(shù)指標(biāo)
7.1.3 集成D/A轉(zhuǎn)換器AD7520，ADC0832及其應(yīng)用
7.2 ADC轉(zhuǎn)換器
7.2.1 逐次逼近型A/D轉(zhuǎn)換器的工作原理
7.2.2 A/D轉(zhuǎn)換器的主要技術(shù)指標(biāo)
7.2.3 集成ADC轉(zhuǎn)換器ADC0809及其應(yīng)用
習(xí)題7
第八章：半導(dǎo)體儲存器
8.1 隨機(jī)儲存器（RAM）
8.1.1 RAM結(jié)構(gòu)和工作原理
8.1.2 RAM的工作時(shí)序圖
8.1.3 RAM的的儲存容量擴(kuò)張
8.1.4 常用集成RAM
8.2 只讀儲存器（ROM）
8.2.1 MROM電路結(jié)構(gòu)原理
8.2.2 PROM電路結(jié)構(gòu)原理
8.2.3 EPROM電路結(jié)構(gòu)原理
8.2.4 EPROM電路結(jié)構(gòu)原理
習(xí)題8
附錄A 美國標(biāo)準(zhǔn)信息交換碼（ASCII）
附錄B 二進(jìn)制數(shù)算術(shù)運(yùn)算
附錄C TTL和COMS邏輯門電路的技術(shù)參考
附錄D 常用邏輯符號對照表
附錄E 習(xí)題參考答案
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