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VERILOG HDL項目式教程 版權信息
- ISBN:9787560667874
- 條形碼:9787560667874 ; 978-7-5606-6787-4
- 裝幀:平裝-膠訂
- 冊數:暫無
- 重量:暫無
- 所屬分類:>>
VERILOG HDL項目式教程 本書特色
本書主要有以下幾個特點:所有的Verilog知識點均配有完整的設計實例;書中所有項目集趣味性、實用性、先進性于一體,易于調動學生學習的積極性。
VERILOG HDL項目式教程 內容簡介
本書按照教學過程中的項目進行編寫,各項目相關知識的推進符合教學規律,書中的內容全部符合IEEE 1364-2001標準。 全書分為7個項目:項目1主要闡述了Verilog HDL標準,并對Verilog HDL完成的兩大功能進行了綜述;項目2介紹了數據流建模;項目3介紹了結構化建模,包括門級原語和層次建模;項目4介紹了行為建模;項目5介紹了狀態機建模;項目6列舉了一些實用的數字電路設計實例;項目7設計了一個簡易CPU,建議將該項目作為學生的畢業設計項目或者實訓項目。 本書可作為高職院校EDA技術和Verilog語言基礎課及其相關實驗指導課的教材,也可作為Verilog語言的初學者和中級水平的讀者的參考書。
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