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包郵 可編程器件應(yīng)用開(kāi)發(fā)指南

作者:王曼珠
出版社:人民郵電出版社出版時(shí)間:2004-05-01
開(kāi)本: 26cm 頁(yè)數(shù): 228
中 圖 價(jià):¥12.5(6.0折) 定價(jià)  ¥21.0 登錄后可看到會(huì)員價(jià)
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可編程器件應(yīng)用開(kāi)發(fā)指南 版權(quán)信息

可編程器件應(yīng)用開(kāi)發(fā)指南 內(nèi)容簡(jiǎn)介

本書(shū)介紹了數(shù)字可編程器件ispLSI系列器件和模擬可編程器件ispDesign EXPERT和PAC-Design的使用。書(shū)中還介紹了數(shù)字和模擬可編程器件的應(yīng)用實(shí)例。

可編程器件應(yīng)用開(kāi)發(fā)指南 目錄

\"第1章 在系統(tǒng)可編程數(shù)字邏輯器件 1 1.1 在系統(tǒng)可編程數(shù)字邏輯器件概述 1 1.1.1 PLD概述 1 1.1.2 在系統(tǒng)可編程技術(shù)特點(diǎn) 4 1.1.3 PLD主要廠商 6 1.2 Lattice公司的ispLSI系列器件概述 7 1.2.1 ispLSI系列器件的性能參數(shù) 8 1.2.2 ispLSI系列器件的結(jié)構(gòu)原理 9 1.2.3 ispLSI系列器件的主要技術(shù)特性 11 1.2.4 ispLSI系列器件的編程方法 12 1.2.5 成熟器件與新型器件 18 1.3 ispLSI 1000系列器件 19 1.3.1 結(jié)構(gòu)特點(diǎn) 19 1.3.2 通用邏輯塊 21 1.3.3 宏模塊 24 1.3.4 全局信號(hào)及結(jié)構(gòu) 27 1.3.5 定時(shí)模型 29 1.4 ispLSI 5000V系列器件 31 1.4.1 器件簡(jiǎn)介 31 1.4.2 結(jié)構(gòu)組成 34 1.4.3 邊界掃描和在系統(tǒng)編程 36 1.4.4 定時(shí)模型 38 1.5 其他在系統(tǒng)可編程數(shù)字邏輯器件 38 1.5.1 ispMACH 4000系列器件 38 1.5.2 ispLSI 6000系列器件 42 1.5.3 ispLSI 8000系列器件 44 1.5.4 拓展的在系統(tǒng)可編程ispXP系列器件 46 第2章 ABEL-HDL語(yǔ)言及其應(yīng)用 49 2.1 ABEL-HDL語(yǔ)言的基本元素和語(yǔ)法規(guī)則 50 2.1.1 基本元素 50 2.1.2 基本語(yǔ)法規(guī)則 55 2.2 ABEL-HDL源文件結(jié)構(gòu) 55 2.3 ABEL-HDL語(yǔ)言的語(yǔ)句 58 2.3.1 標(biāo)志語(yǔ)句 58 2.3.2 說(shuō)明語(yǔ)句 59 2.3.3 邏輯描述語(yǔ)句 61 2.3.4 測(cè)試向量語(yǔ)句 64 2.3.5 熔絲賦值語(yǔ)句 65 2.4 DIRECTIVES指示字 65 2.5 ABEL-HDL輸出文件結(jié)構(gòu) 68 2.6 ABEL-HDL語(yǔ)言的應(yīng)用 68 第3章 ispDesign EXPERT開(kāi)發(fā)工具 74 3.1 概述 74 3.1.1 Lattice公司軟件工具簡(jiǎn)介 74 3.1.2 ispDesign EXPERT軟件的主要特征 75 3.1.3 ispDesign EXPERT軟件的設(shè)計(jì)工作流程 76 3.2 創(chuàng)建項(xiàng)目及選擇器件 77 3.3 原理圖輸入 80 3.3.1 輸入步驟 80 3.3.2 創(chuàng)建新器件 85 3.3.3 原理圖編輯工具 86 3.4 編譯與仿真 87 3.4.1 建立仿真測(cè)試向量 87 3.4.2 編譯原理圖與測(cè)試向量 88 3.4.3 功能仿真與時(shí)序仿真 89 3.4.4 仿真調(diào)試工具 92 3.5 構(gòu)造通用元件 99 3.6 ABEL-HDL語(yǔ)言輸入 100 3.7 混合輸入 102 3.7.1 建立頂層原理圖 103 3.7.2 底層源文件的建立 105 3.7.3 頂層文件的編譯和仿真 106 3.7.4 層次化設(shè)計(jì) 108 3.8 適配與下載 109 3.8.1 引腳鎖定 109 3.8.2 器件適配 109 3.8.3 器件下載 110 3.8.4 芯片加密 112 3.8.5 硬件測(cè)試 113 3.8.6 JEDEC文件格式 113 3.9 VHDL和Verilog語(yǔ)言的設(shè)計(jì)輸入 115 3.9.1 VHDL語(yǔ)言的設(shè)計(jì)輸入步驟 115 3.9.2 Verilog語(yǔ)言輸入設(shè)計(jì)方式 118 3.10 ispDesign EXPERT System文件后綴及其含義 119 第4章 數(shù)字系統(tǒng)設(shè)計(jì)實(shí)例 120 4.1 數(shù)字系統(tǒng)設(shè)計(jì)概述 120 4.1.1 數(shù)字系統(tǒng)組成 120 4.1.2 數(shù)字系統(tǒng)設(shè)計(jì)方法 120 4.1.3 數(shù)字系統(tǒng)設(shè)計(jì)準(zhǔn)則 122 4.1.4 數(shù)字系統(tǒng)設(shè)計(jì)過(guò)程 124 4.2 數(shù)字系統(tǒng)設(shè)計(jì)實(shí)例 130 4.2.1 數(shù)字頻率計(jì) 130 4.2.2 數(shù)字跑表 136 4.2.3 電子數(shù)字鐘 143 4.2.4 脈沖分配器 147 4.2.5 序列信號(hào)發(fā)生器 150 4.2.6 簡(jiǎn)易周期信號(hào)測(cè)試儀 152 4.2.7 數(shù)字調(diào)制(FSK)信號(hào)發(fā)生器 155 4.2.8 逐次逼近型ADC 158 4.2.9 序列檢測(cè)器(數(shù)字密碼鎖) 162 4.2.10 交通信號(hào)燈 164 第5章 在系統(tǒng)可編程模擬器件 168 5.1 可編程模擬器件概述 168 5.2 ispPAC原理及其性能 169 5.2.1 ispPAC10 169 5.2.2 ispPAC20 172 5.2.3 ispPAC與運(yùn)放的比較 178 第6章 ispPAC的開(kāi)發(fā)工具 179 6.1 PAC-Designer軟件概述 179 6.2 PAC-Designer軟件使用 180 6.3 仿真 186 6.4 編程 189 6.5 宏器件(Macros) 191 6.6 在系統(tǒng)下載電纜與評(píng)估板 192 6.6.1 在系統(tǒng)下載電纜 192 6.6.2 評(píng)估板 193 第7章 ispPAC的基本應(yīng)用 195 7.1 輸入輸出的一般問(wèn)題 195 7.2 運(yùn)算電路 197 7.2.1 比例運(yùn)算 198 7.2.2 積分運(yùn)算 201 7.3 有源濾波器 201 7.3.1 概述 201 7.3.2 常用濾波器 202 7.3.3 雙二階濾波器 204 7.3.4 梯形濾波器 207 7.4 濾波器的綜合應(yīng)用 211 第8章 ispPAC20的擴(kuò)展應(yīng)用 213 8.1 精密檢波電路 213 8.2 絕對(duì)值電路 215 8.3 壓控振蕩器 216 8.4 脈沖平衡調(diào)制電路 217 8.5 三角波-鋸齒波變換電路 218 參考文獻(xiàn) 220\"
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