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數(shù)字系統(tǒng)設(shè)計實踐教程 版權(quán)信息
- ISBN：9787562545224
- 條形碼：9787562545224 ; 978-7-5625-4522-4
- 裝幀：一般膠版紙
- 冊數(shù)：暫無
- 重量：暫無
- 所屬分類：>>
數(shù)字系統(tǒng)設(shè)計實踐教程 內(nèi)容簡介
本書作者在總結(jié)多年教學(xué)經(jīng)驗的基礎(chǔ)上, 查閱了一些國內(nèi)外相關(guān)資料, 并結(jié)合自己的工程實踐, 編寫了這本數(shù)字系統(tǒng)設(shè)計實踐教材。作者精心挑選了一些不同層次的實驗內(nèi)容, 從簡單基礎(chǔ)的電路設(shè)計開始, 逐步深入到系統(tǒng)和算法的設(shè)計, 希望通過這些由淺入深的實驗進(jìn)程, 逐步讓學(xué)生掌握電路設(shè)計的入門知識和基礎(chǔ)技能, 逐步提高學(xué)生的電路設(shè)計能力與實際動手能力, 并通過一些實驗內(nèi)容的思考題設(shè)計, 培養(yǎng)學(xué)生的獨立思考和自主創(chuàng)新能力。
數(shù)字系統(tǒng)設(shè)計實踐教程 目錄
**章 數(shù)字系統(tǒng)設(shè)計知識準(zhǔn)備
**節(jié) 數(shù)字系統(tǒng)設(shè)計流程
第二節(jié) Verilog HDL基礎(chǔ)
一、語言概述
二、程序結(jié)構(gòu)
三、Verilog HDL基本語法
四、結(jié)構(gòu)建模
五、Testbench的編寫
第三節(jié) QuartusⅡ使用方法
一、軟件介紹
二、建立Verilog HDL工程
三、結(jié)合ModelSim進(jìn)行時序仿真
第四節(jié) Modelsim使用方法
一、軟件介紹
二、ModelSim基本使用方法
第五節(jié) Debussy使用方法
一、Debussy介紹
二、啟動與導(dǎo)入
三、nTrace介紹
四、nSchema介紹
五、nWave介紹
第二章 數(shù)字系統(tǒng)設(shè)計實踐
**節(jié) “0110”序列檢測器的設(shè)計
一、預(yù)習(xí)內(nèi)容
二、實驗?zāi)康?
三、實驗器材
四、實驗要求
五、實驗原理與內(nèi)容
六、實驗步驟
七、實驗報告
八、問題及思考
第二節(jié) 數(shù)字鐘的設(shè)計
一、預(yù)習(xí)內(nèi)容
二、實驗?zāi)康?
三、實驗器材
四、實驗要求
五、實驗原理與內(nèi)容
六、實驗步驟
七、實驗報告
八、問題及思考
第三節(jié) CRC校驗電路的設(shè)計
一、預(yù)習(xí)內(nèi)容
二、實驗?zāi)康?
三、實驗器材
四、實驗要求
五、實驗原理與內(nèi)容
六、實驗步驟
七、實驗報告
八、問題及思考
第四節(jié) SPI接口設(shè)計
……
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