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航空微電子 版權信息
- ISBN：9787560644950
- 條形碼：9787560644950 ; 978-7-5606-4495-0
- 裝幀：暫無
- 冊數：暫無
- 重量：暫無
- 所屬分類：>>
航空微電子 本書特色
微電子技術的進步是現代科技、 經濟和社會發展的重要推動力。 在航空領域也是如此。 微電子對航空產品的技術水平、 質量的影響如此之大， 對航空技術的應用普及影響如此之廣， 在近幾十年得到了充分的體現。 因而航空微電子技術歷來是各發達國家發展的重中之重， 也是保密的重中之重。 本書嘗試在航空微電子技術方面做必要的梳理性的介紹。 其基本思想是從航空器需求的視角看微電子技術的應用。 全書共七章， 第1章為航空微電子系統概述； 第2章為航空微電子內嵌可靠性理論； 第3章為航空通用核心處理器； 第4章為航空專用加速器及異構處理器； 第5章為航空存儲器； 第6章為航空機載專用總線； 第7章為航空微電子健康管理理論。 本書可作為高等學校電子科學與技術、 微電子學與固體電子學、 航空工程等相應專業選修課教材或研究生教材， 也可供從事航空航天微電子技術相關研究的科技人員參考。
航空微電子 內容簡介
本書共分七章, 第1章闡述航空微電子系統的基本概念 ; 第2章闡述航空微電子內嵌可靠性理論 ; 第3章闡述航空通用核心處理器 ; 第4章闡述航空專用加速器及異構處理器 ; 第5章闡述航空存儲器 ; 第6章給出航空機載專用總線的基本知識 ; 第7章簡單介紹了航空微電子健康管理理論。
航空微電子 目錄
第1章 航空微電子系統概述 1
1.1 航空電子系統 1
1.1.1 航空電子系統的約束 2
1.1.2 航空電子系統的組成 3
1.1.3 航空電子系統結構的發展 7
1.2 航空微電子技術 8
1.3 航空航天微電子技術的特征 11
1.4 航空計算系統 14
1.4.1 航空計算系統的分類與特點 15
1.4.2 航空計算系統的發展趨勢 17
第2章 航空微電子內嵌可靠性理論 20
2.1 引言 20
2.2 工序能力指數 21
2.2.1 工序能力指數的意義 22
2.2.2 工序能力及工序能力指數的概念 24
2.2.3 工序能力指數理論的發展 25
2.2.4 工序能力指數與成品率 26
2.3 非正態工序能力指數 33
2.3.1 工序能力分析中的皮爾遜分布擬合 33
2.3.2 常規非正態數據擬合方法 38
2.3.3 基于切比雪夫埃爾米特多項式的工序能力指數模型 40
2.4 多變量工序能力指數 42
2.4.1 基于空間定義的多變量工序能力指數 42
2.4.2 基于成品率的多變量工序能力指數模型 46
2.4.3 基于權重系數的多變量工序能力指數模型 53
2.4.4 多變量應用建議 55
2.5 高精度正態分布 55
2.5.1 一維正態分布積分限與精度的提高 56
2.5.2 二維正態性檢驗 58
2.5.3 正態分布參數的擬合計算 61
2.5.4 二維正態分布函數高精度實現 65
2.6 樣本容量 68
2.6.1 完整樣本容量 69
2.6.2 非完整樣本容量 74
第3章 航空通用核心處理器 78
3.1 引言 78
3.1.1 航空電子系統對處理器的要求 78
3.1.2 核心處理器分類 78
3.2 核心處理器的發展趨勢 79
3.2.1 多核/眾核處理器的產生背景 80
3.2.2 多核/眾核處理器的理論基礎 81
3.2.3 多核/眾核處理器對航空電子系統的挑戰和機遇 82
3.2.4 多核/眾核處理器的研究現狀 83
3.2.5 眾核處理器的發展趨勢 93
3.3 研究案例；基于航天及空間應用的單片多處理體系結構 99
3.3.1 概述 99
3.3.2 航天及空間應用微處理器的需求特點 99
3.3.3 SPARC V8系統結構 100
3.3.4 基于LEON處理器的FPU和CU結構 106
3.3.5 可配置為并行與冗余結構的雙核處理器 115
第4章 航空專用加速器及異構處理器 132
4.1 引言 132
4.2 使用墻問題和暗硅時代 132
4.3 適應暗硅的架構研究 137
4.4 CoDA架構及能耗研究 142
4.4.1 CoDA架構的定義 142
4.4.2 問題的提出 146
4.4.3 CoDA架構設計 147
4.4.4 CoDA能耗評估 151
第5章 航空存儲器 164
5.1 綜述 164
5.1.1 Cache 165
5.1.2 主存 165
5.1.3 輔助存儲器 165
5.2 跨越“存儲墻”的挑戰 165
5.3 片上多核存儲系統研究的關鍵問題 168
5.3.1 時延 168
5.3.2 存儲器帶寬 171
5.4 片上多核處理器存儲系統的現狀 173
5.4.1 學術界 173
5.4.2 工業界 176
5.5 實例；“龍騰”R2微處理器存儲系統設計 178
5.5.1 “龍騰”R2處理器結構 179
5.5.2 存儲管理單元的設計 180
5.5.3 一級Cache的設計 188
5.5.4 二級Cache的設計 199
第6章 航空機載專用總線 204
6.1 引言 204
6.2 1553B總線 204
6.2.1 總線簡介 204
6.2.2 總線的數據鏈路層介紹 205
6.2.3 總線的物理層介紹 209
6.2.4 相關接口芯片 212
6.3 ARINC429總線 213
6.4 ARINC659總線 214
6.4.1 總線簡介 214
6.4.2 總線的數據鏈路層介紹 214
6.4.3 ARINC659總線活動 216
6.4.4 ARINC659接口實現 222
6.5 AFDX總線 223
6.5.1 總線簡介 223
6.5.2 總線的數據鏈路層介紹 227
6.5.3 總線的物理層介紹 234
6.6 ROBUS總線 234
6.6.1 總線簡介 234
6.6.2 總線的數據鏈路層介紹 235
6.6.3 總線的物理層介紹 240
6.6.4 總線應用情況 249
6.7 FCAE1553B總線 251
6.7.1 總線簡介 251
6.7.2 總線的數據鏈路層介紹 251
6.7.3 總線的物理層介紹 255
6.7.4 國內外對該總線的研究情況 255
6.8 TTE時間觸發以太網 256
6.8.1 國內外研究現狀 256
6.8.2 基本概念 258
6.8.3 網絡拓撲結構 258
6.8.4 AS6802協議介紹 259
6.8.5 主要功能函數 261
6.8.6 時間同步原理 266
6.8.7 同步主節點整體結構 270
第7章 航空微電子健康管理理論 272
7.1 引言 272
7.2 函數、非標稱、因果關系 273
7.3 復雜性和知識局限性 276
7.4 SHM緩解策略 277
7.5 可操作失效管理功能 278
7.5.1 監測函數和模型調整 280
7.5.2 故障診斷 281
7.5.3 失效預測 282
7.5.4 失效反應判定 282
7.5.5 失效反應 283
7.5.6 故障包含度和失效包含域 284
7.6 機制 285
7.6.1 故障容限 285
7.6.2 冗余 285
7.7 規則總結 287
7.8 系統健康管理的實現 288
7.9 啟示 289
7.9.1 探測不可預知的非常態狀態 289
7.9.2 獨立條件下完整知識的不可能性 290
7.9.3 管理體制的必要性和不足 290
7.9.4 接口“干凈” 291
7.9.5 需求、模型和正規表述 291
7.10 總結 292
參考文獻 293
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